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[問題求助] PLL問題,Charge Pump 中 OPamp 的 Bandwidth 該如何決定??

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1#
發表於 2010-8-3 14:55:06 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式

& l0 ~4 S0 N, L) b' }5 u2 u) x4 J0 n" V9 s; N  [" [
如圖所示,小弟我製作了這種架構的 charge pump ,使用 opamp 經 M8 調變讓C .D 兩點電壓相同。
8 w$ `  V; s0 |) a9 U, r
; D4 Q; ~. r& L) o4 p" f然後再使用 CURRENT MIRROR 使 charge/ discharge current 相同- ^* J; r8 C. z/ A

$ l" G% d: P, V( B! U3 F. o8 G6 f/ }- r3 ?' b( l  x  ?
我的問題是,我的 reference clock 是 24MHz 但是 OPamp 再 24MHz 的gain 為負值,CP可以正常使用 ( Icharge = I discharge)
( K8 ^! Z. ]: W0 Q" t% J
0 M# t" M, |4 E/ }照理說 opamp 一端為定電壓,另一端會因 charge/discharge current 而 每一週期改變一次電壓7 T' S4 w8 x, `
+ g5 w8 ?6 j9 h! k4 l& x) |
也就是說 OPamp 會看到 24MHz signal @ D 端3 x# q! S' @$ H5 S0 q) v
) j- M+ A6 \/ ^5 J9 _* @  b
照理說OPAMP GAIN是負值(dB) 在我的 opamp output 端 應該就不會有多大的變化了,但是我實際模擬的情況下 C, D 點電壓 幾乎是相同
$ k& w# \- i4 D6 ~7 z* ^2 q
' j! m! h8 |7 O+ R! S3 _& O換句話說,OPAMP 有在工作。, j+ o* J- N. E7 U+ D8 I5 K
( O8 b1 `' E: H3 K
4 s- E- k8 W; l7 Q* Y. y
請問 1. 我的盲點在哪呢???+ N! Y0 B9 }: _& z
. q- a( |. S+ K, c' A# [8 L- G6 {8 I
        2. 此架構OPAMP 的 BW 該如何去選擇??? (跟 Ref freq有關  還是跟我的 loop BW 有關係??)

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2#
發表於 2010-8-6 17:47:36 | 只看該作者
要不要說一下你怎麼模擬的呢? CL 電壓是從0開始跑嗎?
7 ]8 i6 O1 [. _/ R4 I& U- PC1給多大? 試試C1拿掉看如何? 感覺OP其實是沒作用, 是靠C1在提供current mirror 的bias~
3#
 樓主| 發表於 2010-8-7 00:18:40 | 只看該作者
要不要說一下你怎麼模擬的呢? CL 電壓是從0開始跑嗎?1 g1 K* |; q" X9 Z3 t
C1給多大? 試試C1拿掉看如何? 感覺OP其實是沒作用, 是 ...! z* T5 r' V8 v9 ~$ }( p% W
jackrabbit 發表於 2010-8-6 05:47 PM
7 ?& d9 B. g, f8 w# n) A! t

( u$ S+ l% T% k0 t$ o& m6 s: E. _唉呀我忘了說,我 OPamp 輸出端電壓,有內建 self bias circuit。 故上端 Current mirror 是有用的
2 z8 {' x7 Z4 R6 S- h模擬是使用 cadence 直接在 CP output 接 VDC 掃 電壓從低到高。" `' Z3 h/ M, d3 y, k
模擬後可發現 Charge current = discharge current.
4#
發表於 2010-8-9 11:50:26 | 只看該作者
好問題,我目前也在遭遇這問題,拜託板上高手解答了
5#
發表於 2010-8-12 14:15:00 | 只看該作者
用VDC做的是直流扫描,OP在直流是是有增益的,所以能看到OP起作用了,两个电压相等。但在24MHz动作时,OP增益为负,可能就失去作用了,这时两个电流就不等了。
6#
發表於 2010-8-18 10:33:29 | 只看該作者
用VDC做的是直流扫描,OP在直流是是有增益的,所以能看到OP起作用了,两个电压相等。但在24MHz动作时,OP增 ...
7 M! V# j& W5 b! Blinping123 發表於 2010-8-12 02:15 PM

! \8 D% F: M. g- Q& v2 L3 A
% m3 i1 i8 J$ N, X所以應該要使用暫態分析去看你CD兩點的電壓變化,條件就分別設置使control voltage往上升跟下降的情形吧
7#
發表於 2010-9-15 15:15:53 | 只看該作者
好問題,我目前也在遭遇這問題,拜託板上高手解答了
8#
發表於 2010-9-27 13:36:17 | 只看該作者
雖然我用的是不同的CP% {! m6 k) R* T
但也遇到相關問題
9#
發表於 2010-9-28 15:44:10 | 只看該作者
樓上已經有人回答了啊( l6 ^# q8 s+ z+ _4 M
這要用transient去模擬才對, 怎會用DC呢?
; s7 q- X* {9 Q) [9 `. x6 `+ F跑下去就知道問題在哪了~ 多probe幾點出來看!: k# g, ?7 N6 \2 I$ ~: P9 O1 a
如果不想花時間去寫up/dn的訊號, 就整個PLL接起來跑囉(前提是你其他block都要bug free...)/ y1 `4 h+ m5 P4 e6 e
再想不通再提出來大家討論吧!
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