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各位前輩大家好，小弟最近在研究D Flip-flop 的比較
4 o1 I. {$ @$ L; ~8 y3 T7 J7 |7 z( @
環境設定: a.90nm process* R: s4 r! ]) [# m) ]" X8 b/ V
b.clk = 1Ghz9 A7 N# P/ c+ z9 X/ N
c.hspice model
0 B n I M6 [ d.接成除二電路3 [0 A4 x, [* I) l; g$ `( b: z7 I
Q. V, d/ e4 _. N
想請問幾點問題4 B# i R# _9 h# n/ o
& ]5 [0 u# \* y5 K9 Q. [& h( [/ ?
1.兩架構測出來的動態power，為什麼TSPC會比一般DFF小(clk=1Ghz)
# M+ [8 L) B: m5 p5 m- T: o: X
9 F/ N P6 m4 f* P3 q" f 理論上來講,TSPC為動態邏輯，動態POWER應該會大很多才是: C. v. k2 w3 W4 e2 U% _# n) U! Q
* D, ?4 M, \+ n% t1 m$ r
把tspc DFF 拉高(3Ghz) 才會大於一般DFF的動態power (1Ghz)
+ u7 m6 s9 P) l( q# G& ~, `" r0 f1 f% a3 D2 N% x3 S
2.TSPC還有甚麼缺點？(動態power大很多)& D/ l/ @; w8 x( ^
4 h# @. G" ~5 F& X6 A9 m3 v
優點是速度快、delay小、只需一個clock、電晶體數量少（面積小？）
; z" A% s# R4 T& K+ Y; d: p" R5 E& B3 c S9 X8 z# ^2 }
、靜態power小6 N7 j; k/ y4 d' S5 v
6 O9 T' j: R% p$ a: O! D2 C6 ?
3.既然速度快，power可以藉由電晶體擺法改善，
, p- ^ ^1 W6 r' k/ l6 H/ @, {
為什麼到目前為止沒有Standard cell 可以使用呢?
+ J2 e( T2 M! V. l l e! W
" J0 Y/ a7 M+ F
; F* C) O8 }4 `6 c8 x9 X5 ?感謝大家回答!! |
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狗仔卡
發表於 2013-6-11 10:29:56
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