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[問題求助] 關於PLL的頻寬

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1#
發表於 2008-10-10 23:19:02 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
我看書上說
; A7 f, Z9 `' [( q) d+ |3 H# U"迴路頻寬太小則迴路反應慢"* t& E8 V; d7 F2 ~/ i1 B
我想不透這是啥意思...QQ0 B  q9 Y& D; N) n& J" s

1 E; M! L* Z3 D' Y7 N% J以前學的頻寬應該是定義w3db(high) - w3db(low)$ C! V& ?  X1 X* Q; H! @/ L) p
所以直觀就是操作範圍要在頻寬內
; N. ~" q: O6 F( s$ S但最近看了一些書9 n7 y, P- n2 y) L/ w
有點搞混
; B9 L* D/ T/ h$ L+ h想請問各位頻寬有沒有代表啥物理意思4 o4 a0 z" n* Z  A; K1 E$ S
(ex:追的速度快之類的)
6 a- E7 R  I- s, {* D- g, N感嗯
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2#
發表於 2008-10-11 15:54:00 | 只看該作者

迴路頻寬~~  要看電子學  迴路頻寬~~  要看電子學
! U8 M1 W- \7 A6 t這樣教你   你才比較懂  你先看看書 我之後再回你
3#
發表於 2009-1-7 23:09:13 | 只看該作者
迴路頻寬小,迴路反應慢  也會造成鎖定時間變慢
: I  {: D' @1 e. _但此得到的優點是得到較低的phase noise
4#
發表於 2009-1-9 14:57:05 | 只看該作者
對PLL來說,5 {, e; I* M3 [& `
頻寬大 -> lock快 -> 但是jitter較大
5 W! M* P, [3 Q  ?2 h, x頻寬小 -> lock慢 -> 但是jitter較小
5#
發表於 2009-1-11 20:47:01 | 只看該作者
感謝樓上的分享!!原來PLL的頻寬有這樣作用,先前我也是不知道呢!!
6#
發表於 2009-2-3 16:02:48 | 只看該作者
所以說這是設計PLL的trade off.
" c4 n8 }4 g: K( x8 x/ S, O2 b' ~人人都想要jitter小, 但又Lock快的電路.
7#
發表於 2009-6-12 13:39:58 | 只看該作者

這就是PLL的精隨阿!!

讓小弟我來稍作說明一下!!2 F( }" B; u( a: o
5 E# l3 h1 L2 X9 p; H- {! |
Type2的PLL基本上就是靠PFD將相位差偵測出來,然後藉由charge pump(CP)電流對迴路濾波器(LPF)充放電
  G/ R7 w- Q5 J* x& P
  E- u. o( H: L) n4 u所以重點就是..迴路每一次修正的速度就會和CP電流與LPF值有絕對的關係
+ x7 O' U) R4 [! {6 |6 I( ~
/ N6 v! o2 d5 }- |# M而LPF值是藉由整體系統穩定度之分析所得來的,因此才會有人探討BW對於系統之影響...
2 `" ?5 S* u: K$ q9 T6 A; B+ U% F4 `/ X4 [
-------------------------------------------------1 `0 B: L! ~) o8 ~6 E- V

/ s0 D$ Z* f$ a用一個推導過後的簡單關係式來看 -> 迴路頻寬和迴路濾波器的電容值成反比(very important)
" ~* A8 K1 v- _9 D; z2 |
& S% w; B5 Q! L1 Y6 a; e: Y. a1. 設計時若取"大"迴路頻寬,計算出的濾波器電容值較小,在電流量一定的條件下,每一次充放電的位準增加較快;6 o; H8 e( i) L9 B! \4 B/ c

) L3 ^+ r% k, j. W  k8 l# v& R2. 設計時若取"小"迴路頻寬,計算出的濾波器電容值較大,在電流量一定的條件下,每一次充放電的位準增加較慢;$ p+ N5 J& o9 A0 k7 X9 L
+ ?) H- ^8 `; U- y- z( u& }
以簡單數學式來看 : 大BW時為I*小C=大V(一次變化量大) ; 小BW時為I*大C=小V(一次變化量小) 1 t& [0 P" K( M) V4 \) x( N2 f

( g# F9 G; r* W* `% ], |由以上關係式又可得知 : 大BW時修正變化量大,所以很短的時間內迴路就會穩定 ; 反之小BW濾波器值很大的條件下,電菏幫浦對大電容來說其每次只能產生一非常小的控制電壓變化量,所以鎖定時間會拉長
% }0 F- |- Z, s" Q' Y" i7 y6 S+ G2 u* Y* S; {
總結 : ) ?  d3 Z# {6 R* }6 R7 E
9 B) }4 B1 h) Q5 x+ S' C9 l
大迴路頻寬 -> 較小的FILTER SIZE ; 鎖定時間快
' y+ p0 w! q, Q! {2 \4 k5 Z5 G0 S+ N
4 g  w/ Y; a: z9 f小迴路頻寬 -> 較大的FILTER SIZE ; 鎖定時間慢

7 Y. A& P' I- o2 v+ y8 U, R-------------------------------------------------3 Q9 j. J8 d, n$ p! e, N5 o5 s" J

3 i* K" o7 k) X1 X但在抖動方面沒有一定的定論,因為你要看NOISE是從哪裡來4 \3 {& o; c% i) r' o

# w3 v/ e  F* `* y+ |: P4 Z; F1. 一般來說,若當系統的輸入訊號有較大的抖動時,如時脈與資料回復電路的應用,則此時必需選取一個較小的迴路頻寬,因為整迴路可看成為低通濾波器,若你迴路頻寬設定的越小,將可抑制越多輸入的雜訊
2 ?. V1 ^& ?$ ~- o" ^* ?. e4 @
  B: Y' e; N- p. }) b4 v2. 但是若系統要求一非常穩定的輸出,如頻率合成器的應用,則迴路頻寬就必需設定稍微大一點,因為電壓控制振盪器為一高通的特性,頻寬越大,將可以抑制越多高頻的雜訊。. Q6 W7 Y, x2 R9 i9 p; I9 w9 P2 E7 |
% ?; d. j/ U- ]2 b. c8 X/ s
因此在設計鎖相迴路或是延遲鎖定迴路時,如何選取迴路頻寬值是沒有一定的答案,1 Z2 u6 Z/ R7 W

% K; u1 H, S6 q$ W. T& B/ O迴路頻寬和系統的抖動、鎖定速度、迴路濾波器的值..等等都有密切的關聯性,要視應用而定8 ^) l1 Q( V# o8 ~) Z

+ g  H. H9 L' r) i/ s以上為小弟之淺見,若有問題再一起討論囉!! Good Luck~

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8#
發表於 2009-6-12 16:17:36 | 只看該作者
瓦,很多內容,謝謝各位大大~
% j8 T6 _  k8 O7 |$ O, f7 \謝謝~對於pll我是一個starter,原來有這麼多的講究和奧秘~
9#
發表於 2009-6-15 11:42:58 | 只看該作者
Very good answer, I've learned a lot
10#
發表於 2009-6-18 23:40:56 | 只看該作者
B大好厲害喔~!!!+ L8 Z. F! \) [/ b5 Z
超感謝B大的講解~!!!8 p; B8 `- U5 S3 W$ S
剛好跟大大有著相同的問題~^^
11#
發表於 2009-6-19 13:14:28 | 只看該作者
謝謝B大的解釋
. w  y9 X; U: m" S4 P# y' a- D" S. I1 X4 t  M% T' c
最近也是在想這些問題
9 Z/ i9 z+ h/ T+ V9 o% X' K( d, l; K5 {1 h, f3 v1 ?# W" ]6 O
但是沒有像七樓大大這樣完整的思考
12#
發表於 2009-6-23 17:08:48 | 只看該作者
谢谢上面的解释
4 |$ C6 B% x* k, R真的很详细 透彻& P: j% E0 N$ @$ |- ]
谢谢了9 o% |) o, ?) V
13#
發表於 2009-7-13 04:04:05 | 只看該作者
建議你看書中對於PLL 鎖定時間的推導公式。你會發現鎖定時間確實在式子上是跟頻寬反比的。
14#
發表於 2009-7-24 13:37:34 | 只看該作者
感謝大大的解說和提出,最近正朝向這專案邁進。
15#
發表於 2009-11-24 14:50:08 | 只看該作者
Very good answer, I've learned a lot
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