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[問題求助] 有關於spectre(沒有其他的tool)上用verilog-a作reliability simulation

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1#
發表於 2009-6-27 00:28:58 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問板上大大,
( u6 j7 P# q2 o8 \. D8 D小弟現在想要用利用verilog-a module,6 I* M/ L! a9 ]
把 model card 的 某些 參數作 time dependence的變化,5 _4 e1 ~5 P% s  h
在跑暫態分析時,希望在跑的同時可以因此看到 參數隨時間變化 ,對電路output的影響。; n- {' a7 _* p0 I( Z* S, E
算是作reliability simulation。$ m/ J6 p! \: r
可是小弟自己試了一下,用verilog module去refer to builded-in device model
) i8 D! U/ I  ^4 k在跑暫態分析開始前就會把model參數讀入,然後就跑到分析結束,似乎沒辦法讓它在
( O& v% S* m- l( a1 g0 J3 N+ p! T中間有變化。至於直接用behavior 的方式,由於equation的參數太多了,變成我要. A  [& ]8 n: p7 F: o7 A7 @- ~
把model card的參數一個個直接key in , 也沒法完全和內建的model一樣所以就先不
4 O) O: O5 o  Y  M, v/ Z考慮。不知道板上大大有沒有idea,謝謝
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2#
發表於 2009-6-28 14:57:13 | 只看該作者
要是我的話,我會試一下用clock信號來觸發。0 T& H0 u* p4 L- P. a: i
例如,對clock計數,同時改變參數。不過這不是連續的。
3#
發表於 2009-6-29 23:20:16 | 只看該作者
嗨  大大您好
: j0 a; ~7 y; V& F- L7 Y  r$ i您的想法非常有趣哩) o. \- I2 k# L* K* N- c( L
我在模擬電路也常遇到這種狀況
0 j  H/ m4 f/ J; m4 u! P希望參數可以隨著溫度變動且做tran的simulation4 j. A  E( \* P- V7 j- J) M6 {
不過一直想不出來該怎麼做
4 r1 ?: r2 H6 Z, p" t3 b' U4 ]! j' J# k2 t7 ^/ q
就我所知spectre或是spice要做tran分析時
5 t2 H% G  r' `* [& Sspice會將元件以"大信號模型model"取代
3 }$ j, J( s( D: {這時model card的參數會被帶入到此模型中
# o' r5 O/ q. K  l然後依此模型做時域的分析
2 y. d! y1 K/ @0 [: y那想當然此模型一旦被決定後即無法再以另一模型取代6 E) S0 |' @  E
想想看如果突然改變一參數帶入  則model將不連續# L: z& X  _! |  R# o
不連續將造成transcient不收斂
3 O1 w; E" }+ _$ u; [' Q亦會無法得到結果# o$ M+ x6 k7 k8 Q: l8 x; Q' d; D$ N

/ j: Z5 }2 K$ W3 }# l+ A這是我的猜想啦...........
5 j6 S8 I* e. Q6 S# g1 \: ?我也是一直想知道有沒有其他方法可以做到
: k4 G5 [1 S! Q$ W0 iverilog a 我用過但是不熟........
% p2 B. N  o1 T2 t: n. o4 f1 [! s溫度隨時間變化在業界其實常常都會碰到(甚至可說相當重要)+ p, }5 S: ]3 K* Q
要是可以輕易達到
4 Y# w6 P- _; h$ q我想spectre和spice沒有理由不去做
$ J* Q* V) ?  y應該有它困難的地方吧~!
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