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[問題求助] 請問各位先進有遇過這樣子的問題嗎?

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1#
發表於 2007-5-17 20:38:50 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
我目前是碩班的學生,專題是做CDR(Clock and Data recovery),# _9 K# z6 A7 J* G" A  o
最近chip回來正在量測遇到了怪問題,+ }0 d; U, \2 k! _9 o6 |
我先量VCO部分,VCO是使用7級Inverter串聯的Ring Oscillator,示波器是使用安捷倫 54853,; i+ z, U5 j8 T* K7 |) Z9 g
儀器的碳棒是有分正端和負端,正端接訊號源,負端則接地,
& p  z+ Y0 e" H: X再量測VCO時,如果有接GND則會出現下圖,
$ A) d1 t% a. h6 k6 Q1 N
2 ^; z0 E0 ^3 [* ~$ c不接地時則如下圖,% v2 F, B5 P6 q4 l

( j' K, f5 d' E" c0 q  C8 M1.)這是為什麼會這樣子,在探棒接不接地會有這麼大的影響,哪一種比較準確。% r; b- b4 K0 O: O
) [7 }4 b5 ~) n6 e- e! n! a
2.)在波型上為什麼會有向settling time這樣子的抖動波形,是設計方面的問題嗎?% D  n+ B7 f/ v; |
ㄧ開始我以為是電源不穩定所產生的抖動,但是在接了regulator以後還是會這樣子,) k- R8 d( i( p3 p/ Y
這是什麼現象呢?或是我該在設計的時候注意哪方面的考量,可以消除這個問題?
: B+ l) h( t, x2 m7 x4 q& o, y
" L( D8 d9 e! a7 D# D3.)在類比的gnd和數位的gnd這兩個在製作PCB版到底要不要隔開,還有分開接以後gnd到最後不是還會接在一起嗎?. l0 d/ U* m; n4 Y$ ^, K
這樣子有隔開根沒隔開還不是一樣,或是有其他的接法,聽說兩個有隔開後量測結果會比較好,改怎樣解決呢?' b/ \4 m- m  O+ m, G

* c+ P7 ^% c: ^# c2 k  x% e在這裡請教各位做類比的先進,麻煩大家幫我想想是哪邊出了問題,謝謝大家。
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2#
發表於 2007-5-17 22:09:17 | 只看該作者
1. 要接地!
+ c7 X1 S( Y' `* u+ D& m) H
$ X; M) S+ c/ e( z2. Bonding Wire 的電感效應!, {1 p9 P3 s, l7 w* T9 Y
0 x" y* O2 F# T  B; j8 G9 g
3. 要分開! 可以用一種隔離元件分開!  大多數的人避免麻煩!  所以接點最後都會接在一起! 但這點離POWER的GROUND最近就可以了!
3#
發表於 2007-5-17 22:16:40 | 只看該作者
這個隔離元件好像是電感是嘛? 不知有無記錯?

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參與人數 1 +2 收起 理由
sjhor + 2 對!可是我忘了專有的名詞!

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4#
發表於 2007-5-17 22:33:11 | 只看該作者

Power & Ground

對呀...是用電感分開digit及analog的大地...
; l2 E: M/ L6 ?* X0 b( \" S9 X: W- n. }. h  _1 J9 r
power的部份...也可以利用電感與電容的濾波來得到比較好的穩壓效果~

評分

參與人數 1Chipcoin +2 收起 理由
sjhor + 2 Good answer!

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5#
 樓主| 發表於 2007-5-17 23:24:02 | 只看該作者

回復 #2 sjhor 的帖子

對不起我忘記說明了,我這個電路是要應用在生醫,) N; H6 N* |  f8 {
所以頻率做比較低2MHz,這樣子在Bonding Wire的影響會很大嗎?
6#
發表於 2007-5-18 08:40:58 | 只看該作者

回復 #5 jelly811737 的帖子

應該這麼說!8 v7 r. Z' F  }/ A9 d
除了 bonding wire 之外, 外面的連接線(PCB, ....)有多會有電感的存在!
: l3 V3 S* k, C( u. {0 S+ z* i所以  累積下來的量也不可以小看!
" S- W3 J, T7 v, L3 }
1 A- g; O% G/ D& _1 U還有的  就是 你的  Driver 做的可能不是很好!
3 `) \$ R$ R! G% L, N& x. @3 y  u# Q或者是 Rising/Falling 太快所造成的!# Q6 F) B3 L: h, H$ R, ?
0 m- P: X$ q* H2 E1 K
若是很 Care 這些!  應該去找一下數位的  OUTPUT pin 設計方法!4 O3 R# j  ]9 I. K4 T8 Q
應該有機會解決!
% o0 C+ G9 q4 x9 [
9 ~( J. \2 ^; j: e) [  N* @找到相關資料後!  歡迎拿出來分享唷!
7#
 樓主| 發表於 2007-5-18 10:23:03 | 只看該作者

回復 #6 sjhor 的帖子

請問sjhor先進可以�我如何評估Output Load,然後如何設計Driver,) L, t3 @  |3 I+ i
Digital Output pin?  Oscillator不是算是類比的嗎?
- p+ m& `: E1 [為什麼要用Digital output pin?這是什麼意思呢?5 W  x, R- o* ^3 K  n, @, V/ I* ?9 u& O
小弟學不夠多看的也少,還有很多方面都不是很清楚,希望你多多指教。
9 ~+ Z& t( f9 y* {+ S% L$ J3 `在這裡也謝謝你的回答。
8#
發表於 2007-5-18 11:18:38 | 只看該作者
0與1 的信號   通稱 digital signal!; E, m4 [9 @  k( s, m6 l
只不過 Output Buffer 友可能是 analog designer 幫她們設計的!
# x& G  j- G. Z3 m6 w
3 ?2 t, Q3 J& C0 `. Z) L2 W0 cOscillator 是類比的沒有錯!  Y6 I9 F. U8 v2 H  `6 F/ Q9 o; ~
但經過  sensing amplifier or Schmitt trigger 轉換之後  就是數位的信號了!
# ^  N, n. E. P4 B* H" ]- J3 g/ ^) D# [, s7 {7 A
這一部份 Output buffer 主要的工作是數位的!
  R4 f. X% u5 d5 k; ]
! }+ h+ a% V0 ~$ B/ V所以  這邊  她們有開發一些技術! 可以避免這些情況!
: i" q, Z5 _3 O. V0 c+ _- V* P0 q5 b
我記的的是  信號快升到 VDD 時  友作ㄧ些的處理!1 ?8 a; e$ u3 _5 c1 H. f
這一部分  我只聽說!  沒有見到實際的電路!, e: U9 l/ A5 N  g4 T2 a0 v( _
所以不能提供給你! Sorry!
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