在Astro的SDC FILE用set_multicycle_path指令就發生錯誤

jianping

Dear all~~
. t7 ?# M8 p7 h. Z5 o" U能不能請教一下,因為我再SDC FILE用了set_multicycle_path 指令,所以Astro 在load SDC File 時,就會發生錯誤(No pins matched),難道ASTRO 不能用這個指令嗎??

LOAD SDC FILE時
Astro 訊息
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Info: starting Tcl processing
" N/ F1 i! c( n; Z. n6 GInfo: building design object name tables
Warning: No pins matched 'TOP/test/mul/A[26]' (SEL-004)
+ J) k6 H: W7 M' m4 `5 U& v, mWarning: No pins matched 'TOP/test/mul/A[25]' (SEL-004)
; v) i  o1 h4 [8 w4 s, \2 F
----------------------------------------------------------------------------
3 g+ o7 U0 j# qSDC FILE
. F& F3 A3 _: y% Q$ y( s" e, z# h
% |7 \5 v: z: q: Aset_multicycle_path 9 -through [list [get_pins                                 \
6 Y# f! @! g: X: O{TOP/test/mul/A[26]}] [get_pins                        \
{TOP/test/mul/A[25]}] [get_pins                        \

# F, w+ s: ^* F  q* u# [
-----------------------------------------------------------------------------
! P8 ], `0 h& O5 e. T- J! V" w! cVerilog File
9 h7 s4 H, C* C6 C- |$ d
8 y9 ^0 n! s& x- Q9 `' V  uniquify_mul_0 mul ( .A(icwAeYfSum[26:0]), .B(
        icwAeYfNum[18:0]), .C(ae_avg) );

chyauchyau

請將這個PIN設在PRIMITIVE CELL的INPUT
  _* l. y  A- s* P9 U) Zuniquify_mul_0應該是個module吧
; K& ~9 w) U. I1 m
0 E$ z9 E9 l1 p4 l3 o  \chyauchyau