SOC驗證！大家都用什麼語言？

jiming

哪些公司在用SystemC做???

8 w6 |3 X/ ]; v- VCurrently, there are 4 following types of languages...

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masonchung

SystemC 在 ConvergenSC , SOC Designer 都有強力的支援
) z) I; x" S$ k! g0 f: T% O& m這屬於ESL design , HW/SW Co-sim at the same platform.

hgby2209

感覺 systemverilog 不錯, 雖然還沒開始使用, 不過我有聽過幾次相關的研討會,
覺得 Systemverilog Assertion 會對較複雜的 Design 做 Function Simulation
! {7 r5 m3 l& \  d1 b7 T$ E5 J很有幫助...
據我所知 support systemverilog 的 Tools 如下:
MentorGraphics --- Questasim (如果不 run system verilog 也可當 Modelsim run)
/ r2 p+ O! w7 Y3 h& m0 d" rSynopsys -- VCS
, g( \4 Q' x5 j2 @3 s4 V% h9 g3 vCadence -- IUS (NCSim)

phoenixfeng

我们还在用verilog，不过正转向system verilog的阵营，估计其他的验证语言不会存活太长时间了

chungyuan

投 System Verilog 一票
不過 simulator 支援的步調稍嫌慢了點
) \. ?9 |6 u* B: B加油吧 EDA Vendors　

sendra

現在學校的老師很多都用SystemC了.......................

gengwd

我会投SystemC一票，在HW/RW协同设计时，SystemC 有灵活性，目前在建模方面SystemC有优势!

vinvv

System C吧
7 n) V3 X4 f5 ~9 h7 [) @學校好像也都強力在推
2 C+ R7 U+ A/ f) _, u開課也是如此
( i" U* w6 W4 J5 s! t0 E感覺還滿有發展潛力的

nanosoc

systemverilog, coverage dirven verification

tk02561

ARM與Synopsys擴大合作關係 達成以ARM架構為基礎之 SoC的功耗及效能之最佳化 並加速相關設計和驗證
" }3 F# |: s. ~' h+ D% g/ {6 y. X4 S
! g" f, B% B9 `) n重點摘要：
4 |6 R8 u) K0 g/ r·         兩業界領導廠商擴大合作關係，嘉惠ARM合作夥伴生態系之共同客戶
" ~5 I" f) W6 m" U9 B·         新思科技(Synopsys)取得節能高效ARM IP的多年授權協定
# Z) I. M& H9 Z5 A) C; Z$ U# g5 C·         透過新思科技Galaxy™實作平台及ARM Artisan® Physical IP及POP™技術為ARM® Cortex™處理器，提供最佳功耗及效能的方法論
3 P3 J9 R( S( I·         新思科技下世代Discovery™驗證IP (VIP)整合新測試、檢查和驗證功能，加速AMBA® 4 ACE™ SoC的驗證  
; y0 ~0 Q4 q  ^1 k
(2012年8月29日) ARM及新思科技(Synopsys)簽訂一項多年期協定，進一步擴大新思科技(Synopsys)使用ARM矽智財(IP)的權利。雙方將擴展合作關係，讓SoC設計人員透過新思科技Galaxy實作平台及Discovery VIP達成以ARM架構為基礎之 SoC功耗及效能的最佳化，同時降低成本並加速上市時程。新的協定乃以先前EDA工具及ARM Cortex-A15處理器授權協定為基礎，允許新思科技取得一系列Cortex處理器的使用權利，包括執行ARM big.LITTLE™處理的技術、ARM Artisan實體IP、用於Cortex處理器實作的POP技術，以及CoreLink™互聯(interconnect)和AMBA 4 ACE系統IP。
. ]2 W) {& e6 s& M/ Z7 \) t
藉由雙方的擴大合作將最新的ARM技術納入合作範疇中，新思科技得以為ARM處理子系統的實作和驗證開發並提供最適工具和方法論，而ARM也能藉此強化其IP。雙方的合作旨在滿足設計人員對SoC節能高效的極致需求。例如，ARM big.LITTLE處理作業將Cortex-A15 MPCore™和Cortex-A7 MPCore處理器與ARM CoreLink CCI-400高速緩存一致性互聯(cache coherent interconnect)相接合，以便針對每項任務讓軟體無接縫移轉至最適處理器中。就一般工作量而言，這樣的模式可節省70%的處理器耗能。

tk02561

ARM執行副總裁暨處理器部門及實體IP部門總經理Simon Segars表示：「面對競爭日益激烈的市場環境，業界兩大領導廠商攜手合作提供最佳解決方案，以加速設計流程並提升功耗及效能表現，此舉將可有效協助設計開發ARM 架構為基礎之SoC合作夥伴。而擴大新思科技採用ARM IP的權利，雙方彼此的客戶將受惠於簡化的設計及驗證流程，進而達到快速上市時程。」

. p9 f& d' [8 E$ `透過ARM和新思科技的專業合作，優化的實作流程將利用新思科技的Galaxy工具和方法論以及ARM Artisan實體IP和POP解決方案，協助設計人員加速開發以Cortex-A9、Cortex-A15和Cortex-A7處理器為基礎的設計，並提升效能及功耗的表現。該解決方案亦搭配針對ARM big.LITTLE處理的新思科技Virtualizer™ Design Kit (VDK)以及針對AMBA 4 ACE規格的Discovery 驗證IP及通訊協定分析器(Protocol Analyzer)。

除了結合新思科技的Galaxy工具與優化ARM處理器方法論，設計人員也可利用新思科技的Lynx Design System透過經投片驗證的SoC層級實作流程，執行額外的生產力及可預測性測試。新思科技也提供最佳處理器實作訓練和設計支援，協助客戶在所選擇的半導體製程技術中達成效能及功耗目標。新思科技也將為ARM IP達成Discovery驗證平台的最佳化。Discovery VIP及通訊協定分析器整合額外的測試、系統監測檢查及其他功能，以加速AMBA 4 ACE互聯設計的驗證。
; S" h" N: e( _6 o2 K
9 b' N. i! A4 D8 P: Q+ B3 [8 T% i3 J新思科技全球技術服務資深副總裁Deirdre Hanford表示：「新思科技的設計工具已被使用於大多數以ARM處理器為基礎的SoC之先進設計實作中，而我們的客戶正努力追求效能及功耗效率的極致表現。雙方的擴大合作將讓新思科技和ARM為SoC設計人員提供最佳解決方案，以滿足其ARM晶片設計的功耗及效能要求。」

globe0968

(台北訊，2013 年 3 月 6 日)   全球電信設備及網路解決方案領導供應商ZTE (中興通訊) 宣佈採用德州儀器 (TI) KeyStone 多核心系統單晶片 (SoC) 用於其小型蜂巢式基地台產品。TI KeyStone SoC 是可編程多核心處理器，協助 ZTE 開發同時支援多種 3G 與 4G 空中介面 (air interface) 標準的無線基地台。
) L8 o0 h4 O3 [" s+ O
1 r" ]% t* W) M8 d( y$ p5 FZTE GU 產品經理Wanqiang Wen 表示， TI KeyStone 多核心 SoC 在設計時充分考慮了軟體定義無線電 (software defined radio; SDR)。TI KeyStone 的多標準比特率協同處理器 (bitrate co-processor; BCP) AccelerationPac 目前可處理 UMTS 與 LTE 封包，有助於建立真正同步雙模式 (simultaneous dual-mode) 的小型蜂巢式產品。此外，TI 軟體平台提供良好基礎，幫助ZTE專注開發差異化軟體無線電特性。

. x, P" W/ N6 d4 |. I為了滿足無線營運商不斷提高的降低資本支出需求，ZTE 正積極開發軟體定義無線電基地台解決方案。以 TI KeyStone 架構為基礎，ZTE 小型蜂巢式產品可使網路營運商簡易變更無線服務特性，包含支援不同標準或不同標準組合，只需現場修改軟體即可獲得同步雙模式。TI 優異的 KeyStone SoC 架構可在實體層 (PHY) 處理硬體加速、韌體靈活度 (firmware flexibility) 與軟體可編程度之間取得理想平衡，實現產品差異化。
' G: T* ~" U  |7 U3 _. ]
TI 通訊基礎建設總經理 Sameer Wasson 表示，對於與ZTE 合作打造支援乙太網路與真正同步雙模式的小型蜂巢式基地台解決方案，TI 深感榮幸。TI KeyStone SoC 可在降低功耗同時展現優異效能。此外，TI 多核心軟體開發套件與經過實地應用驗證 (field-proven) 的 UMTS 實體層功能庫可縮短 ZTE 產品上市時程，使差異化基地台設計更加靈活。

globe0968

TI 最新DaVinci™ DM369視訊 SoC針對百萬畫素IP攝影機實現業界最佳低光技術
8 Z& t, G/ f9 B- J: V1 x  D2 Q: d
(台北訊，2013年4月17日)   德州儀器 (TI) 推出最新 DaVinci™  DM369 視訊處理器，具備業界最佳低光技術的百萬畫素IP攝影機，該 DM369 視訊 SoC 提供影片安全製造商運用卓越低光技術，實現清晰銳利影像品質。由於DM369視訊SoC與DM36x系列視訊處理器接腳相容，TI 現有客戶可利用此卓越技術優勢輕鬆擴展現有IP攝影機產品，為市場帶來重要差異性。TI 可擴展 DaVinci 視訊平台可提供創新解決方案，協助客戶以迅速、簡易、低成本的方式，設計差異化 IP 攝影機。

符合視訊安全開發商需求
TI DaVinci DM369視訊SoC提供客戶優於同類競品 2 倍的卓越低光效能。基於 DM369 的 IP 攝影機在停車場或暗巷等極低光環境，亦可獲得清晰影像提供用戶辨識車牌、人臉或協助執法單位破案的跡證。藉由H.264/SVCT格式，攝影機可進行即時視訊壓縮與傳輸，同時抑制雜訊 (noise filtered) 與加強動態範圍 (dynamic range-enhanced)。

( `9 h7 t% X* z2 K2 ~$ VTI 解決方案主要差異化功能：
•        500萬畫素以上影片解析度，具備高效率 H.264 壓縮，節省頻寬與儲存空間；
•        同步多類型 (基本/主流/高階) 編碼提供最佳視訊品質與相容性；
1 L$ E7 R" }" J5 q+ W•        業界最佳整合影像訊號處理 (image signal processing; ISP) 技術，實現「逼真」影像品質，並搭配臉部辨識、視訊穩定 (video stabilization)、魚眼校正 (fish-eye correction) 等功能。

globe0968

工具與軟體協助開發
& @5 Z3 v. B! d, ?. U7 n1 _* XTI DM369視訊SoC 提供眾多工具與軟體生態系統，協助監控產品製造商加速產品上市時程。 該 DM369 IP 攝影機參考設計包含圖表 (schematics)、電路板 (layout) 與BOM，可提供客戶重複利用在TI  DaVinci™ 產品系列上所做的投資。DM369 IP攝影機參考設計符合ONVIF規範，客戶可簡易整合自有攝影機與 NVR 與 VMS 系統。客戶設計解決方案可同時根據市面上最熱門感測器選擇TI 感測器模組生態系統後再上市。

TI IP攝影機產品行銷經理Jacob Jose表示，TI DaVinci視訊處理器始終是監控產品製造商的不二選擇。藉由第三代 3D 雜訊抑制 (noise filtering) 與寬動態 (wide dynamic range; WDR) 處理技術，以及業界最佳低光效能，TI 實現打造更安全世界的承諾，滿足安全應用需求。

價格與供貨
0 J9 g2 }  `4 Z) c2 T2 J4 UTI DaVinci DM369 IP攝影機參考設計現已開始供貨，建議售價為 995 美元。TI DaVinci DM369視訊SoC將於4月底開始提供樣品。DM369視訊SoC價格資訊可洽詢 TI 或授權經銷商代表。

ranica

CMOS Sensor FAE 经理

9 J% D* }9 e% T. [3 {6 C# y公      司：A CMOS image sensor design company
. V* `) ^7 T0 V$ r3 h6 M工作地点：深圳
* k: R) L3 e: M1 P8 _( ]/ d5 ?
* V0 `& `9 W) c6 h& L岗位职责：
1. 负责CMOS Sensor的图像调试；
2. 协助图像效果分析及算法优化开发；
3. 负责公司FAE团队的日常管理及工作安排；  
4. 对公司内外部进行产品培训和讲解；
5. 协助解决用户在产品使用过程中遇到的问题，组织人员提供技术支持；  
7 w) R% i3 O4 {0 [, _# {* z6. 撰写产品文档及数据分析报告；  
1 K6 ]7 n  V9 Z6 G- L) E7. 根据用户需求、结合产品功能提供合适的解决方法；
8. 负责FAE团队的建设及管理。
2 u" Q4 E. u7 L+ X1 F3 ^. p
5 y( \5 v- }2 _# n  z8 A- }任职要求：
7 \) f- P" y& A" q( T$ t1. 电子信息工程、图像与信号处理、计算机等相关专业，本科及以上学历；
9 Q$ y& ^( L  M  y% x2. 熟悉Aptina、OmniVision等常用CMOS芯片的图像采集原理及工作流程；
9 z1 j2 D* L0 G( `/ E3. 熟悉C/C++以及嵌入式软件的开发流程，具有嵌入式Linux驱动的开发经验；
4. 具有至少2年以上视频处理类产品的图像调试经验 ；
5. 了解数字降噪、边缘增强、色彩还原、对比度增强、宽动态补正常用的图像处理算法优先；
7 Y* Z) z. G" a! \* {" O: M6. 具有良好的团队精神和服务意识。

ranica

Senior SoC Design Engineer
公      司：A global PC leading enterprise
: ~) {( h8 Z# i& X. n2 U3 S工作地点：北京

; X; S0 ~7 [, _% J. T' Y4 EPosition Description:  
1. Lead high performance SSD controller SoC architecture design
         高性能SSD 控制器芯片架构设计
  T6 A* e0 }1 ~' m9 ]5 Q0 Z8 R
2. design emulation platform for complex SSD controller  
) Y9 s9 i" t5 |$ s         开发复杂SSD控制器原型平台。

% S1 Z! ?5 X: n) J4 [8 b3. Work closely with cross-functional teams to enable pre-silicon RTL development  
         与架构、软件团队成员通力合作，完成流片前的RTL开发。
, W9 D0 J. X" z" t7 o
4. Validation of SoC design and system level use case and performance scenarios on emulation platform  
         在原型开发平台上验证SoC设计，建立和维护系统级用例和性能测试。
8 J1 @! B7 J  w2 {# [- d, q6 C
& Z  S: P5 b( A9 E5. Lead system level verification of enterprise/consumer SSD controller using latest verification methodologies  
         采用最新的验证方法学进行SSD控制器的系统级验证。
4 y  h# C$ z5 o, C1 _+ p
6. Post Silicon bring up, functional/performance validation and debug
         流片后的系统功能和性能的验证和调试。

ranica

Requirements:
6 B( n" s: x0 e$ m* F1. At least 5 years direct work experience on FPGA based product development or IC front-end design, in storage/server/telecom industry. Experience in SSD/HDD product design is preferred.
/ ^$ @& K5 M/ y9 c9 w" @" _# R* m         5年以上存储/服务器/电信领域FPGA产品开发或IC前端设计经验。有成功开发过SSD/HDD产品经验的优先。

2. Familiar with PCIe interfaces. Experience in SATA/SCSI/FC is preferred.
* O, d; }* L* [* b* E         熟悉PCIe接口。有SATA/SCSI/FC接口协议开发经验的优先。

* B( l/ ^3 J# p  [" R. d1 T$ ]# I3. Familiar with DDR3/4 interfaces, ECC (LDPC/BCH).
% J- |0 z5 h) e7 h8 T/ L' v# u         熟悉DDR SDRAM接口, ECC (LDPPC/BCH)等纠错码开发。

% c; V: `. h! C/ G' {, {4. Familiar with eMMC/NOR/ONFI/Toggle interfaces is preferred. Deep knowledge of NAND Flash architecture is preferred.
4 U  J% l, Q; T. S& z         熟悉eMMC/NOR/ONFI/Toggle接口协议的优先。熟悉NAND Flash底层结构的优先

5. Good understanding of STA and SDC.
         熟练掌握FPGA开流程和静态时序分析和约束。

- G$ e0 Q, z; I/ u- }9 W! e6. Good understanding of SoC and on-chip bus. Experience in AMBA AXI3/4 is preferred.
         熟练掌握SoC和片上总线概念。有使用AMBA AXI3/4经验的优先。
  
% j! v" z, O" u' aCommon skills
( ]4 {0 J) x5 N5 m( \; n; m/ ?! |1.  Ability to ramp up quickly in new technical areas.
4 m/ i) h/ U( Z2 J$ J* b' @具备快速进入新技术领域的能力。

+ p" q7 ~# |  _& A: I2. Creative thinker.
! V6 Y/ G3 N; \具备创新思维。

3. Good communication skill in both English and Chinese.
2 M0 {: _4 ], D# E" G, [良好的英语和汉语沟通能力。
! a0 F" k% F1 X( a4 _5 u
4. Team-working, good communication and committed to delivery  
8 z  n  W( q5 J! |% J  R, d+ u具有团队合作精神和良好的沟通技能