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像是自己在設計電路
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然後趕在CIC下限前2 m8 ^% F6 W e! }. c
" r( h" ], `2 {! {# b% {拼命的LAYOUT. s" i4 O# @5 J# u+ ?/ E
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有時候,老師說要改規格4 R7 ]0 K( v( U4 z8 w* ^
6 Y; A$ v7 s! A或是其他人說你的LAYOUT要考量一堆要件時: r* r, h- w/ G1 V8 t" v
& f+ |! J9 u I& ]那時候真的很吐血啊∼!∼!
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像我個人就覺得LAYOUT真的相當的累人
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$ j1 h0 n9 n# G) D尤其是再跑LVS的時候 Y! L5 P/ e5 C7 R, U
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除錯debug真的是要人命啊∼!! |
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