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像是自己在設計電路
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然後趕在CIC下限前
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% b# R5 u" H; g+ }$ B3 q4 E拼命的LAYOUT+ A6 y* o$ P7 ~6 g& F9 U% H2 s5 ]
" x" C' S$ A0 e5 m4 r+ e% F4 n有時候,老師說要改規格
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或是其他人說你的LAYOUT要考量一堆要件時5 j* O+ D5 @2 }; C9 w! z" Z1 _/ ^# d7 K
+ A n6 n* l0 `! x5 ?那時候真的很吐血啊∼!∼!# l4 C N; Y2 Y, C( c0 V
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像我個人就覺得LAYOUT真的相當的累人, `4 V: d+ v/ `" P
) {* r( |: D9 B) v6 V尤其是再跑LVS的時候7 E' c" T6 U0 J! E6 e0 s, M+ |% a. j
6 b; G( P1 O- t5 y& B5 w+ b除錯debug真的是要人命啊∼!! |
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