CALIBRE LVS & DRC

tkrubychan

請問一下有誰大概可以跟我描述一下 LVS 跟 DRC 一些基本的概念!!

比如說怎麼去認一個NET DRC怎麼比對的呢? 比較內部的分析
6 ]% E- i" z. _* d/ k* k  B; V5 F
2 P6 k7 ?' B" L6 O5 k" ?  d  p/ m# v謝謝分享...

crystal_blue

極簡單的說DRC 就是Design Rule Check 的縮寫，也就是依照Design Rule來check你畫的layout
7 u: V7 j. x  ^5 U8 L9 I$ L只要將check 出來的error部份修除就ok了

極簡單的說LVS 就是Layout vs Schematic 意思就是layout跟電路的比對
除了比對電路有沒有接錯還會比對model有沒有畫錯。
4 N) g0 ?$ \" ?% C0 ^$ }7 O
另外請問您的問題NET DRC 是什麼意思?因為沒看過所以沒辦法給你解答。

tkrubychan

喔 不好意思 我沒有逗號逗開 我的意思是說 lvs 是用什麼樣的原理去比對... 他樣去認出一顆mos 或是 inv 呢??
2 n4 d1 G- s$ h2 Y. h+ x
6 @0 i% |" E: \# D* _3 l8 W那他怎麼去認出 那根NET 要跟哪個NET相接 SPICE上寫的NET 他怎麼去判斷的呢!?

是這個意思拉...DRC也是  他比對DRC時 是怎樣比對 一層一層 或是用座標 之類的 相關資訊 ^^
, C# p9 S" `7 O3 o. W; j+ F5 o! {
2 C! W+ @* }- S# O謝謝你

crystal_blue

簡單的說~你要的答案可以在LVS & DRC 的COMMAND裡找到

LVS的原理就跟之前所說的一樣，CALIBRE 如何去認到MOS 除了COMMAND外
, J4 D2 H; M6 i; W) r% ?8 r你還必須STREAM IN SPICE ，COMMAND裡會去定義怎樣的條件下他是PMOS
還是NMOS，如何判定是INV是去比對你所STREAM IN 的SPICE ，在LAYOUT中
+ L- Z' t. \! `& [2 S如果有PMOS 跟NMOS的連接方式跟SPICE中的定義相同那LAYOUT就是INV，至
於如何找到特定的NET，除非在電路中就事先寫入，不然在CALIBRE RUN LVS時
, R. H# N% ]9 t所產生的NET NAME是隨機排序的，不過有些LAYOUT的TOOL有辦法認到NET，
( X" \! H3 ]  c6 W但也是必須事先設定。
" f, y, w; y$ l) s
: o! _. k  J8 B& j4 `$ g( G/ JDRC的原也跟之前說的一樣，COMMAND FILE 會去依DESIGN RUN 裡的規則然
後寫出一連串的句子，將所有層的可能的相對關係以條件式的方式寫入，然後再
5 e/ ~% |8 z+ J利用TOOL 去比對並將結果顯示。
  S/ _% M' Q: R- L" x% T8 H
以上是我所了解的部份，希望有幫你解答到。

x014067

學了一年多，現在才在這裡看到原來是這樣的縮寫，以前都只會用，但不知道有這樣的意義所在，真是受益良多阿!!

yoyo20701

大大的解釋真好~~~小弟了解囉~~多謝唷~~多謝你的無私~~謝謝

ricky000

我看我看我看看看
8 {3 I* K; Q: B: ^3 X我看我看我看看看
我看我看我看看看
我看我看我看看看
1 ?+ O# E  I( q" y我看我看我看看看

oligxoi

請問一下大大們
% A" g8 Y4 G2 j' {. @. r要跑lvs時
$ E4 t% ^( P4 _, O0 \' G7 u要產生.sp檔一直發生錯誤
0 p, p2 N9 }8 n" h  b. W沒辦法成功
" M1 w5 b' ^: W% a, k+ U( i請問是甚麼問題阿

mask40169

我看我看我看看看
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我看我看我看看看

張智揚

請問一下大大們
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沒辦法成功
請問是甚麼問題阿
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2 O5 Z, n, E/ ?7 B+ D- T! @可以將問題敘述更詳細一點嗎?
( y. F+ W6 f7 F/ E, l  }這樣才可以確切的解決大大的困擾~

machu-picchu

請問一下大大們
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沒辦法成功
請問是甚麼問題阿
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不管執行什麼程式,都會記錄在紀錄檔裡，例如： *.log,
你先開 *.log 看看是什麼原因？

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大的解釋真好~~~小弟了解囉~~多謝唷~~多謝你的無私~~謝謝