M0 M3 M4 Soft IP Cores For Sale

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├─AT420-DA-03001-r2p0-00rel0
│  └─docs
7 ~" F0 F+ a! c9 t, P0 N) v │          DDI0337G_cortex_m3_r2p0_trm.pdf
- a& K4 R& y9 J/ Y$ l( N  I3 g │         
7 ?" D+ K- u; I* @0 D) @! \ ├─AT420-DC-02008-r2p0-00rel0
│  └─docs
' b/ i& ]7 k4 y8 ]$ G) n │          DII0194A_cortex_m3_r2p0_csg.pdf
/ O3 R5 s5 f/ B& u │         
2 R! Q! {: S: r( G8 u ├─AT420-DC-13001-r2p0-00rel0
( w& T$ b; t' `) M │  └─docs
! T$ Q( x! w. C" B, u
) R, w! i1 t# Q# i7 f  ` │  │  │          CM3CodeMux.v
8 \" z" k5 D# }/ h1 U │  │  │          CM3flashmux.v
: ?$ b! d1 O4 o# \+ W( J │  │  │          CM3ROMTable.v
│  │  │          CortexM3Integration.v
2 C- [( S$ Z) Q0 V. p! r5 @ │  │  │         
0 {2 F! O& m; z( h │  │  ├─dapswjdp
│  │  │  │  README_DAPSWJDP
7 ]0 }6 k( ~$ W9 g3 N* T# `3 s │  │  │  │  
│  │  │  └─verilog
│  │  │          DAPDpApbDefs.v
│  │  │          DAPDpApbIfClamp.v
1 A/ y3 v4 i4 f" @; Q │  │  │          DAPDpApbSync.v
- V# ~, d, Y6 ]. o4 r │  │  │          DAPDpClamp0.v
# Q) v) h% o3 N+ X* } │  │  │          DAPDpEnSync.v
$ u% i" h1 P" N │  │  │          DAPDpIMux.v
) ~( B3 ^/ [: R# d2 X0 Q+ H │  │  │          DAPDpSync.v
7 k7 Z6 j( @# Z- B& b+ `1 J  l │  │  │          DAPJtagDpDefs.v
" H3 A4 D( k* E │  │  │          DAPJtagDpProtocol.v
│  │  │          DAPSwDpApbIf.v
2 d  E. C5 }; o6 E1 a' E+ ^ │  │  │          DAPSwDpDefs.v
│  │  │          DAPSwDpProtocol.v
- r- p" \  x2 Q │  │  │          DAPSwDpSync.v
% U& G" q% M& N/ H! O) z │  │  │          DAPSWJDP.v
# b3 i* J0 `; V. X9 v7 j8 v0 o │  │  │          DAPSwjDpDefs.v
. L$ f+ R3 y- y2 ]0 X │  │  │          DAPSwjWatcher.v
- p- W* R$ G! j0 b5 b, a │  │  │         
│  │  ├─models
│  │  │  └─cells
│  │  │          CM3ClkGate.v
│  │  │          CM3EtmClkGate.v
) y7 W: v0 |6 V' d5 j( i │  │  │          CM3Sync.v
│  │  │         
4 o; I7 U( m; z │  │  └─tbench
│  │      └─verilog
" L. `& v" w+ v$ a6 S& D% \+ C │  │              AhbToApb.v
│  │              AtbLogger.v
│  │              BusMatrix.v
│  │              ClkReset.v
$ @1 L. _% w; |/ K( C │  │              CM3BusComparator.v
( \7 d1 T/ T4 b
7 ?0 n  L7 s$ K; V( i4 b9 G
│      │  │  exclude_list.sc_waitstate
" G1 q1 S; L8 ~; R/ q4 o
, l) d! N, D$ V" O& Y6 G# r             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
! K: S! F2 j) c5 d1 i5 `" f             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
             │      │  
             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
, {" n. I4 @0 \8 @  m             │              cells_1.geo
, e/ H$ H; [8 S) B: X             │              cells_1.pwr
             │              index.cli
  r9 n! s0 \( Z6 m( H0 v             │              README.TXT
& c9 |! Q. R% e- M$ f             │              rulesets
             │              VERSION.TXT
             │              vias_1.geo
8 {) Q  B8 r# C, H- M             │              
, T( X- _/ `& P5 _4 c/ A             └─tsmc
                 └─t-n90-lo-sp-002-f1_1_6a_20060914
                     └─6X2Z
" B2 A5 `7 O5 }                             corner.defs

% n' |8 g, J3 H$ _' ~├─integration_kit
$ t9 M: X; R# F5 ?% T: D5 Z0 _ │  ├─logical
│  │  ├─cm0ikmcu
9 N  S+ Z% X' T' D, Y │  │  │  └─verilog
( @5 b+ H, X1 u& c" X( J │  │  └─tbench
│  │      └─verilog
$ o; v0 a. f/ q; G0 k& b. i) F │  └─validation
│      ├─glogs
( k! v0 P8 O* a4 F+ c │      ├─logs
│      ├─mdk
│      ├─srpg
│      ├─tests
/ q5 ^4 X. Z/ a │      │  └─CMSIS
* ^7 F9 L. H6 Q3 D5 e$ O │      │      └─Core
, O, N+ K% J& t: w# M │      │          ├─CM0
│      │          └─Documentation
& E- B" i3 l" h7 |; Z. {: p' M │      └─vectors
├─ipxact
4 d# }( L: v( T* b# M- H' c% `% U │  ├─busdefs
│  │  ├─amba.com
│  │  │  └─AMBA3
) M" ]0 q' ?1 W+ K0 u. Y( K. H2 C │  │  └─arm.com
0 D% o$ w8 X0 F7 e$ h │  │      ├─CoreSight
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