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[問題求助] 請教FPGA差動輸出的問題

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1#
發表於 2009-4-28 19:53:30 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
大家好) G7 K' O* {5 b

* D2 S% M# G# ]4 ~  H' g想請問一下
9 @  e* A  Z$ a* ?6 R
7 ]2 F7 Y$ t# V0 k7 H現在我的FPGA外接4組driver IC6 @7 T$ q2 j* B) H, C! A
- f/ A1 M" D/ ~0 E
此IC為differential type的輸入
; O. s' e/ V0 M5 _9 [& \' ]! H0 a# h: A0 i3 F! J& K
2 T$ Q4 @) s. v* [" Z% L& z  Z
我現在每一筆控制data為4bits (期望能操作在500MHz以上)8 N9 u% F  {1 H: f; k
& G; [  X6 F, W. _
每一個bit分別同步控制一組driver IC. N$ f& F* G3 U2 n! n; S& \4 y
% \) I& a( ~. p" j$ [0 o

: G& e! X1 x5 b! y  z& ]8 D+ `我想請問一下
. k) N; Q# \$ @9 r$ K0 V$ |
( z0 S& ?0 T, E( e我想把每一個bit在送到driver IC之前5 ~3 [5 k: p8 c* h; {
  i9 B( [" f" G( ?# n
先轉成differential mode
- K, F! {, ?- F& V0 N4 h) S9 S5 x; ~# i
" M' v. s! O) ]" |) `. g0 y
我現在的想法是7 a8 r6 v, x% R3 Y/ x
8 K+ c2 w$ |& s& O1 i# Z$ I* B/ ]
寫個differential mode 的module
$ W. Q5 v& E; `4 O; d* v& W* O6 R# c% j; o' J) w  Z
此module很簡單+ h3 E  p& N0 A! J5 ?

: _9 Z% k3 U, y" W* z- o; R- ?為單一輸入
! N. _( |0 L1 F, j  k. Z4 W6 [
  c* ^& G$ r2 c+ p4 ^6 _* N; ]+ N經過一個buffer 與 一個反向器# T/ D( ]6 k2 |5 A; B6 b. {

" n% P; D# S+ ]  k( j; f; _1 C的雙輸出9 G( m( v  H& a6 U
1 E+ j+ z; |. A8 g9 e; g7 L

/ P. T1 z, X& f, E% u3 E: Z& X0 J  m- d0 j" E7 v

7 f3 W+ a* C/ a7 h3 u  e感謝
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2#
發表於 2009-4-28 22:31:27 | 只看該作者
請使用DDR的IOB並把IO type設定成LVDS即可
+ M; Y, k+ H, E9 M' ~7 m) [  g不需要特別去設計一個module
3#
發表於 2009-5-6 18:41:20 | 只看該作者
直接使用的話,skew 的問題要特別考慮
  W' {' |. R1 e" N  B1 `. \另,一般 fpga,有現成的 differential io 可以用/ V8 f" M' l( O1 y1 ?. {
不過如果是 500 MHZ 的話,可能要挑一下了 ???
4#
發表於 2009-8-17 10:52:50 | 只看該作者
千萬不能這樣用! l  f) i  {( [* b# g7 i
在高蘋上面你必須考慮兩個部份
# q" ]* z. H3 n外部PCB必須等長1 v9 L! ^* A9 s* G+ M/ W
內部在LVDS buffer 之前的routing
- O, \. Z( X* ^1 [- D2 q不然你會q到死
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