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[問題求助] 請問一下FPGA要怎麼實現高倍的倍頻電路嗎???

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1#
發表於 2009-5-27 14:03:45 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
不好意思~~想要請教一下各位前輩們~~
# n5 |8 S" }# J- |( ?- x我所使用的FPGA晶片是altera的Cyclone系列~~~1 d( \! F0 i# @5 ?& U
我現在遇到了一個問題,就是我電路板的input clock是48Mhz,但是我想要讓FPGA可以輸出二個clock分別是32.2Mhz跟48.3Mhz~~
0 u. N9 t  \1 a9 l1 Y4 r6 a" I我查過了Cyclone系列的PLL分頻跟倍頻ranges只有1到32而已,明顯不能達到我的要求(輸出没辨法為48.3Mhz)~~
: o2 ?+ J, y# h1 f5 {% Y) f, j$ G所以我想要找看看有沒有什麼方法可以設計出一個高倍的倍頻電路~~不知道各位前輩們有沒有人有經驗??
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2#
發表於 2009-6-2 15:12:54 | 只看該作者
第一個PLL 做一個100 MHz的頻率出來* T" P! F$ T0 z8 `+ t
第二個PLL的輸入就用 100 MHz 再去做你要的頻率就可以了
3#
 樓主| 發表於 2009-6-2 15:37:35 | 只看該作者
原帖由 topplaza 於 2009-6-2 03:12 PM 發表
+ H9 O$ V' J/ [; V5 p第一個PLL 做一個100 MHz的頻率出來, g+ `% M! Q! Z" J* v
第二個PLL的輸入就用 100 MHz 再去做你要的頻率就可以了

2 ]8 v6 _& S6 E" P( Q0 ^! N) m# q( x- l' P% U) H2 K1 q# M2 Y/ b
我試過這樣去做
7 ~$ W2 O, c1 _: s3 b' `' z  ^但是Cyclone系列的PLL輸入頻率只能使用外部輸入頻率" d) n2 c. t. c9 c: h% Y/ @. v
而我電路的外部輸入頻率只有一個48MHz而已
# u: A' K5 x) N# u1 i所以沒辨法這樣做* |. H& c; ~4 {0 G" Y2 }3 p
* W4 |( t$ g' U6 ?
而且還有一點就是Cyclone系列的PLL本身的除頻跟倍頻都有限制5 f1 ?& s  D# H$ m% y5 k- ]
只能做1到32的除頻跟倍頻; p2 H* C+ J7 Q8 h0 q* a5 S- j4 i
所以照您的說法下去做也行不通
. q  H4 E  j5 h/ V; i
5 q1 E( I+ j  p" }' \9 ^5 J6 p不知道還有沒有那位前輩有其他的方法?? (跪求Q.Q)
4#
發表於 2009-6-3 12:02:34 | 只看該作者
这方案怎么定下来的?
; l. \& e5 j; f很难想象哪里有这样的应用,输入48M输出48.3M7 ?6 q$ K" T+ T' Y: Y
要锁频吗
5#
 樓主| 發表於 2009-6-3 13:02:38 | 只看該作者
其實原本是要求要做遞增的
% H: W. H0 C& H' Y* L) D5 m" s輸出頻率由48MHz開始增加
  L, d/ |! }8 @1 r2 j一次增加0.3MHz直到63MHz為止% l9 A) l+ @% p8 Q, K# v
但是我現在連48.3MHz都做不出來; ]0 t; P" U2 I( o  o, {
所以才會上來問問看有沒有人有什麼建意
; m  b% x, [2 R  h' I* k# S
* _4 Y% [; ~) n0 m# t[ 本帖最後由 tmwcndjjmj 於 2009-6-3 01:12 PM 編輯 ]
6#
發表於 2009-6-3 17:16:27 | 只看該作者
原帖由 tmwcndjjmj 於 2009-6-2 03:37 PM 發表 * s4 [/ W3 l1 F" @) g4 F

2 J/ E; C) b3 G- @/ }  F2 |( g3 y& M$ d- r4 S0 O! \, P  S+ G) ]
我試過這樣去做
. [* ]( {! Y3 O" f: B, J0 u; S4 c- e但是Cyclone系列的PLL輸入頻率只能使用外部輸入頻率
# H( D  ^9 @" B5 g7 O* s" ?而我電路的外部輸入頻率只有一個48MHz而已% L1 E" v7 n- l" |" K. q4 K
所以沒辨法這樣做
5 g  t; `) o* h0 t  h6 z
  [: D$ y$ ^! U4 U% b5 y而且還有一點就是Cyclone系列的PLL本身的除頻跟倍頻都有限制
3 E4 d8 q3 M% u/ P只能做1到32 ...

$ x) s/ J# \+ T( Q; l# p$ i) D
8 O  x* k. I: |$ N( q可是我試一下 Cyclone的PLL是可以做到啊!
: r$ W- f; P) t# |) ?% H/ pPLL的輸入port有專用的pin腳,在內部二個PLL相連是沒問題的
; G' W8 K: |" K- Y) x, A你是在合成時產生錯誤訊息的嗎?
7#
 樓主| 發表於 2009-6-4 09:50:32 | 只看該作者
原帖由 topplaza 於 2009-6-3 05:16 PM 發表
7 ?' {6 ~; Q# C, J
4 I5 N+ }! w% D  A5 {( c6 Q$ m( a- q) {# Y1 F* B& ^
可是我試一下 Cyclone的PLL是可以做到啊!+ d; W  |. X  ^/ j/ c
PLL的輸入port有專用的pin腳,在內部二個PLL相連是沒問題的
# L! f+ G% v( b8 J" }你是在合成時產生錯誤訊息的嗎?
  D) ]3 Q1 W1 k5 [) Q- A% U- t, Z) Y

: l1 J3 l+ t0 `5 I我也試過你的做法,是可以設定一個輸出48.33333MHz
7 |* s* M  S% e/ q7 E) g但是我compile到Fitter(Place & Route)的時候就會出現ERROR
$ T* q6 V& r8 T  k所以我才會上來問問
8#
 樓主| 發表於 2009-7-3 14:34:39 | 只看該作者
問題決解了
) h; u  g% P* ?( L$ m/ d謝謝各位的幫忙6 M5 t5 n& y. x* C7 O
最好還是使用counter來計數4 Q$ M% i1 U5 }# e1 U$ K; p& L' c
不使用改變頻率來控制了; T8 G$ A" h+ y7 x; z9 t, Q! Z% D  E
然雖同步方面算了很久才達成
6 u9 H6 G2 m" q不過總算是完成了
9#
發表於 2011-12-29 17:59:36 | 只看該作者
回復 8# tmwcndjjmj 9 R1 }) r. g- \2 D4 l

% ^% `* P2 k/ D$ C* \$ p' z  E9 ]2 K: u/ k4 J: F, C
土法煉鋼    ? 辛苦但直接.
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