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layout 設計風格之討論!

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1#
發表於 2008-12-11 14:45:38 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
layout人員拿到一個電路以後,應該如何布局電路呢(我只指一個模塊)
4 Q- e' F9 g/ `. d) U/ D6 }! f3 W: f+ |+ {4 E& [: V7 t
我喜歡把PMOS和NMOS各放一排,PMOS放在上面,而NMOS放在下面。電源和和底線呈上下平行走線。這樣似乎比較浪費面積。匹配管子比較偏好交叉二維匹配。
) ~  Y% t" W0 u. c7 u) n: a/ O; y3 l. c$ t1 U  J
各位大大,你們是怎么布局的呢?
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2#
 樓主| 發表於 2008-12-11 14:47:34 | 只看該作者
請大家說說自己的風格。討論各種方法的優缺點。
3#
發表於 2008-12-17 19:41:47 | 只看該作者

回復 1# 的帖子

應該先看看是類比電路還是數位電路吧?
0 V6 s6 E' l: z5 ^3 {
0 m0 p) |: I1 F( A% }如果是邏輯電路 PMOS NMOS分別放上下兩排
- ~/ r  h( p* I0 C% x4 e這我也是這樣做
% r$ a$ L. U* d* O7 j! t. [% k! c3 @0 y
類比電路就不一定了
4#
 樓主| 發表於 2008-12-18 10:48:16 | 只看該作者
咋都沒有人討論?????????????
5#
發表於 2008-12-18 12:43:39 | 只看該作者
我觉得Digital和Analog差别还是比较大的!" l7 a) t) O4 w  i. D
Digital主要是size方面比较优先考虑" E. R' ?$ g& k8 T) U

9 x/ m- ^- [3 l; z% KAnalog主要是性能和匹配方面要优先考虑
6#
發表於 2008-12-24 17:23:02 | 只看該作者
我lay的是analog ic,我習慣先lay 重要的mos(p/n),接著擺重要mos上面或下面的current mirror,最後再擺switch mos或logic gate。一邊擺一邊想訊號怎麼走,power路徑等等。當然最後都會是一個很漂亮的方形。
7#
發表於 2008-12-24 20:37:26 | 只看該作者

回復 6# 的帖子

,很不错!
8#
 樓主| 發表於 2008-12-25 12:52:22 | 只看該作者

回復 6# 的帖子

有段时间就这个问题有点困惑,6楼兄弟给我了点启发!不错。
9#
發表於 2008-12-26 20:11:25 | 只看該作者

感恩

贊哦∼
! P, j$ t7 g* Y$ G& U感覺真是收穫良多
8 t# ^* T8 |5 ~; ^) N' W8 D  ]/ z* \謝謝各位大大無私的奉獻贊哦∼( F" h9 P# l! M7 z
感覺真是收穫良多
4 ?3 x9 O* J" v% O% C; W謝謝各位大大無私的奉獻
10#
發表於 2008-12-29 17:38:14 | 只看該作者

回復 6# 的帖子

完全同意...
+ \1 V- X) V7 b' L5 t還有我會留意所有的well, diffusion 是不是足夠,而且最好是矩形9 s) D9 |4 M7 E  q' ?/ I' @
再看看metal 上的via 是不是足夠,多加一點可以對yield 有點幫助
11#
發表於 2009-2-3 15:20:32 | 只看該作者
謝謝6樓大大這麼好的見解。
" Q) x( W9 o( \4 \/ }進layout界快滿2年,總覺得自己還是原地踏步…' l: \+ }7 r" s( J, x
有時想起來挺慌的。
12#
發表於 2009-2-3 16:11:18 | 只看該作者
多做项目才行!多看产品也行
13#
發表於 2009-2-9 17:01:50 | 只看該作者
是啊,我进入Layout行业也快一年了,感觉自己进步的很小,每次看到人家的布局,就感觉自己画的太刺了.
14#
發表於 2009-2-11 15:36:57 | 只看該作者
看電路的複雜度 先做好floor plan 儘量做成方型 才是 layout 王道呀!!
15#
發表於 2009-3-5 09:41:09 | 只看該作者
学会合理布局才算是入门,要知道自己为什么这么布局,好处在哪,还有什么要改进的地方,能说出一二三来,就算有进步了
16#
發表於 2009-3-5 10:55:46 | 只看該作者
真是好觀念
& L7 V" J2 U  o! u0 l3 ]先劃重要的mos再劃current mirror其他留最後
4 K* \0 Q! H' |- g* u不過通常結果大概都是pmos在一起,nmos在一起
/ f, n( q+ r  T所以我以前總會有analog layout與digital layout plane: U8 D2 D) C8 Q6 Y6 e7 Z/ E
很像的感覺,現在離清它們不同之處了
17#
發表於 2009-4-23 15:09:19 | 只看該作者
會先了解POWER LINE的路徑走向為何
. H% G( p6 Y: Y0 h/ z! p: b# v5 f* _再來擺放MOS即接線, q0 o% p4 b4 `: ^0 V, g
或許有些籠統; h0 F5 \/ t; P6 b4 _
因為我LAY的是DIGITAL
0 v0 B. T+ l0 e$ K, F所以了~~~盡量壓空間就是了, E- Z$ B6 w2 k- Y7 v; D7 z
當然最後還是要成矩形
18#
發表於 2009-4-23 22:17:10 | 只看該作者
贊同六樓大大所言7 I% |2 E3 a6 K$ c$ {/ E" R
3 @3 N% l6 H2 X: K
analog ic,我習慣先lay 重要的mos(p/n),接著擺重要mos上面或下面的current mirror,最後再擺switch mos或logic gate。一邊擺一邊想訊號怎麼走,power路徑等等。當然最後都會是一個很漂亮的方形。
19#
發表於 2009-7-20 12:02:33 | 只看該作者
我是會先看整各TOP電路的關連, 想POWER LINE 要怎樣走,接著跟六樓樓主差不多,也事先把一些 current mirror 或是需要common centroid 的MOS 先畫,燃後在慢慢擺上一些比較不需要注意對稱或是偏數位的電路上去,先考量效應跟連接的關係再考慮面積(類比電路),
20#
發表於 2009-7-20 15:19:10 | 只看該作者
如IC過大, 需與其他人共同合作的話, "界面"與訊號可能要先定義清楚較佳.; f7 D2 r6 i+ s# }! y
確實, analog layout 不能清一色要求面積小, sensitive path, cross talk, match, and isolation 要優先考慮...
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