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[問題求助] 請問TSMC .18 rfnmos問題

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1#
發表於 2009-6-26 19:32:23 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
最近使用TSMC .18製程畫layout
0 n9 }8 \5 r( N- z$ f使用PDK所叫出來的RF NMOS最外面那一圈是deep nwell所拉出的4 z) f# S/ a( P3 m$ x! ^4 I
而裡面那圈是接body用的 我都是接到gnd2 x2 c8 f# F8 \0 u9 D# X: S. F
- Q% `3 Z  m# I. u' a; V) L0 |
因為先前看過幾位畢業學長的layout, G, v" P3 Q, O  ~
他們最外層那圈都是跟body接在一起 也就是接在gnd; `' Y$ t) M5 s9 t; q/ M
不過照理說那不是應該要接在VDD嗎?+ F' C: h0 z4 I( `( x7 A: P. @
如果是跟body一起接 layout起來是方便多了5 G2 O+ e$ {1 w( {
因此請問一下最外面那圈應該要接到VDD還是gnd比較好
: K: C- y! o6 i" P3 A但如果接在VDD的話 是否最好另外接到另一個不是該電路的VDD
3 r2 B, O) i6 h7 }5 @而是另外一個VDD比較好* O; s3 K. x$ c- P

9 y  P  G6 c+ c% v, m+ @5 D謝謝
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2#
發表於 2009-6-26 23:27:05 | 只看該作者
deep nwell不該與gnd連接。! b9 ]6 d- z, O% W  q# ~4 `; r9 D( R' F
deep nwell 起隔離作用,它把它所包圍的nmos和襯底隔離,減少了nmos受到的雜訊干擾,如果deep nwell直接與gnd相連,而且你這個gnd很可能是與襯底相通的,所以不能其隔離作用。
8 j; ~9 q- L& p: V但是如果你這個deep nwell 中的nmos是負電壓的話應該可以這樣畫。
# S: h' O- O& N( x' P. n: C
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