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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功 ...
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[問題求助] 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功能達到最大

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1#
發表於 2009-10-20 14:20:24 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
5Chipcoin
如題: I1 v1 B" G+ s& Y1 d% T9 E
請教前輩們 在LAYOUT regulator 時 其中有大量ESD MOS的佈局方式 該如何會比較恰當
6 R' Y' z9 c& S! n! z8 P$ A* ?: T2 k
6 ~* s7 a1 [* A0 A# q0 D/ U然後又該注意哪些問題  因為我的w/l  30/0.3  現在再跑 POST- SIM.  發現到每個GATE 端電壓都不相同
  Q: {: p# M# U" U' k- E9 X7 T4 E! L9 d& F
請問有哪位大大知道問題嗎  然後那個MOS 為M 228  感謝

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2#
 樓主| 發表於 2009-10-21 14:10:46 | 只看該作者
就此問題 已有解決的方法了
; p% b* j" ]6 [發現到 應該不是我的LAYOUT問題  j- w3 E$ y2 {4 \+ h* g! h
應該是我打Label位置的問題 導致 RD在抽RC值 跑POST-SIM.出現% Z6 g9 O- E) ]4 k. D! b5 v
輸出訊號異常問題  重新標定過LABEL後 以解決此問題了 感謝
, M! _  \. w4 Z" g
: k, ~' A" }9 e5 T# d% r& z
& |2 ^1 j. g# b6 ?' b" l# y煩請站長將此案幫我做結案  感謝
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3#
發表於 2009-10-26 16:00:36 | 只看該作者
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4#
發表於 2009-11-20 17:16:29 | 只看該作者
回復 2# clarkhuang . O' y! ^) D0 s9 ~) Z3 l; r6 \
( V  L% {1 G) e; J' s' \1 A9 ~
7 N5 n, Q9 X: L3 r2 G" g9 M
    下次在多注意一下就好
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5#
發表於 2009-11-20 17:18:09 | 只看該作者
LAYOUT要靠經驗的!!!加油* Z2 A2 x! q- a. I/ q& Y3 H% u" F
LAYOUT要靠經驗的!!!加油' S* b$ a- M: A- [& @
LAYOUT要靠經驗的!!!加油
3 ]& S: n  O# X* v! H% y& T1 FLAYOUT要靠經驗的!!!加油& R4 {/ i  A* w+ T
LAYOUT要靠經驗的!!!加油9 Q* C/ p/ u% }3 T7 C2 d  O
LAYOUT要靠經驗的!!!加油
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