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[問題求助] 關於下線的問題

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1#
發表於 2010-5-13 17:52:30 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
近期可能要下教育性晶片,但是看到教育性申請須知與說明上頭寫了一段話
5 p4 X& \! f9 z1 b! T: O+ }- B1 v* k+ U. ]0 a* b
6. 繳交檔案及資料:3 N. s, A# h& s0 C+ D
申請人必須於申請截止日P.M.17:00前完成下列1) 至3)項,繳交資料不全者、逾期者皆不受理。
" w( j% G- k$ T& H  v/ d% x8 X1) 請ftp 技術資料:& H5 Z% I6 @$ Q+ x7 J- u% _
[1] 佈局檔4 Q2 j5 X5 V( w- g% ^, Z3 x6 F: R8 }
[2] 佈局驗證結果檔(DRC、LVS或Apollo驗證結果檔)  N8 f) P  c4 k( w3 \: o
[3] Tapeout Review Form。+ l, H( R; X$ j' n' P# Q
註1:不可使用cell library。: m! }- v4 l/ z/ E: n
註2:佈局檔案上傳完後請上傳「OK」檔,以檢查上傳佈局檔是否無誤,並至晶片上傳檢查系統網
* L1 S/ K, d% R8 o+ r頁: “http://www2.cic.org.tw/~shuttle/chipworks/ ”以確認申請是否成功(若網頁上無其上傳資訊者,
" c( z  w; d! ?! n視同無申請)。
: y1 ?4 {# ^' S) G- @
3 H) W4 X  S. D5 {- u7 |) \紅色的部分還不太懂它的意思,是說不能用tf檔裡面的cell,還是連自己畫的cell都不能叫出來用?
  c+ r; Y. j& J麻煩幫我解答....
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2#
 樓主| 發表於 2010-5-14 11:47:12 | 只看該作者
前輩可以幫忙解答嗎% H/ @" H/ y) l6 V  H; @# m

+ p; F6 |. l2 G; q, z1 N( \& @真的很急...
3#
發表於 2010-5-14 19:05:35 | 只看該作者
是指不能用標準元件庫 (Standard Cell Library) ' y8 t& Z" R9 N3 N0 t
用全客戶方式去下線就對了
4#
發表於 2010-5-14 19:28:20 | 只看該作者
意思就是所有電路 包括邏輯閘都要自己畫就是了$ s( U5 s  e4 {% L: R: X1 B# [
full customs bottom up design
5#
 樓主| 發表於 2010-5-14 20:39:08 | 只看該作者
非常感謝~~~~你們的解答
7 {) s& [) l8 \  ]
0 f# g2 R( J* {: a" |: Q+ u1 ]. U那自己畫的CELL可以叫出來用嗎?
6#
發表於 2010-5-15 00:49:58 | 只看該作者
自己畫的當然可以
% P" u/ s5 r/ _& R; ]- |0 ?它的cell是指 CIC 或TSMC幫你做好的cell
1 i8 Q& S/ I2 e5 q" p因為是教育性晶片...chip size跟gate counts 都不會太大: P& c( w* h1 N
所以他希望學生全都自己動手
9 o8 N9 i" F- x7 E) Y& h  dPADs 則可以使用TSMC或工研院提供的cell
9 t" A: ?+ ?# c- V" v( X只是不能違反它的命名規則8 M8 O4 U; `% a! \0 t. p! I8 j
前瞻性晶片就可使用cell library 而且面積沒限制
7#
 樓主| 發表於 2010-5-15 01:48:03 | 只看該作者
回復 6# shangyi - h+ @2 G% e; t; I9 W) }5 y0 l

+ ]! }  l" ^9 ?& X恩~我了解了~~~非常感謝前輩的指導
8#
發表於 2010-5-19 17:14:45 | 只看該作者
原來是這樣~~了解 又多學一件事
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