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[問題求助] Power MOS架構問題

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1#
發表於 2007-12-27 17:20:38 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
有誰公司有畫過類似Power MOS架構,能在TSMC製程畫嗎,如果能那W/L如何計算,因為Poly會有重複的問題需要知道。
9 C# q' A, _6 h* d) z

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2#
發表於 2007-12-28 17:47:41 | 只看該作者
左手邊的將POLY重疊的部份去掉假設POLY是1U" i3 z4 p& z! u0 G( e
POLY to POLY是2U  每條POLY 為17U
- d0 Y- o$ S+ c# p7 G17*10-5*5=145  @4 s: M) {4 Q& c/ V. i6 S# h6 m
右邊這個就沒有重疊的部份,但卻有打折部份的損失,0 `+ }7 s0 b8 ~+ T
看你要多精準,粗略的打折部份就算是1/2,+ N) t7 f1 o# _" e4 o
就這樣子
3#
發表於 2008-1-3 09:50:01 | 只看該作者
通常  POWER MOS 應該不用算到這麼精細吧!!! b6 R# L" I5 A' N4 D1 ?
他是看整個 Rds(on) 所以  這些的誤差應該是可以忽略的吧!!
4 B7 |* q  [5 G. C" T7 U口字型要看她的整個結構  還有引電位的問題!!
/ L& H. Y& |5 f/ g, w口字型  應該是對稱性的結構比較好畫!!% U  L" Q5 z* E9 P9 k# d
若是 DMOS 目前還沒有實際的使用過!!
4#
發表於 2013-1-31 14:48:12 | 只看該作者
Rds(on) 是什麼??$ M1 u6 W- j, M9 x6 b
怎麼判斷Rds(on)?
5#
發表於 2013-2-27 15:29:18 | 只看該作者
希望各位讨论,多谢大家, 。。。。。。
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