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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功 ...
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[問題求助] 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功能達到最大

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1#
發表於 2009-10-20 14:20:24 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
5Chipcoin
如題
: n" {* i3 Y1 O3 V( k5 L, t0 l# t請教前輩們 在LAYOUT regulator 時 其中有大量ESD MOS的佈局方式 該如何會比較恰當
( e" h" b; d, o; [
- a, z( r* C( ]- ^3 x然後又該注意哪些問題  因為我的w/l  30/0.3  現在再跑 POST- SIM.  發現到每個GATE 端電壓都不相同
; F" N5 @7 g% e- M+ Z& l/ t
0 A1 X. F& a/ y- a請問有哪位大大知道問題嗎  然後那個MOS 為M 228  感謝

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2#
 樓主| 發表於 2009-10-21 14:10:46 | 只看該作者
就此問題 已有解決的方法了, ]' {) g, R3 V9 t
發現到 應該不是我的LAYOUT問題
& u5 k0 A/ _) @- _8 W6 Q/ f應該是我打Label位置的問題 導致 RD在抽RC值 跑POST-SIM.出現- ^$ A, O2 g$ Z, Q2 C! W
輸出訊號異常問題  重新標定過LABEL後 以解決此問題了 感謝
9 M' M* `3 a. E) B! e+ k- b' I$ N6 n. U( T0 L) e8 C$ a+ Z  v

  T: l  v7 {4 R: k煩請站長將此案幫我做結案  感謝
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3#
發表於 2009-10-26 16:00:36 | 只看該作者
提示: 作者被禁止或刪除 內容自動屏蔽
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4#
發表於 2009-11-20 17:16:29 | 只看該作者
回復 2# clarkhuang
5 s1 B* Y& a7 a/ Y3 `
: o  o1 I  [, a1 t" w3 b/ d) w& C9 b, L, [) e- N' Q( c9 V: r; L
    下次在多注意一下就好
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5#
發表於 2009-11-20 17:18:09 | 只看該作者
LAYOUT要靠經驗的!!!加油
% \7 A. ~# `0 s2 TLAYOUT要靠經驗的!!!加油
% f7 ^  r; q+ T- c5 f. }LAYOUT要靠經驗的!!!加油( ?3 a, Y: L6 m  K. `  w' O% j- I
LAYOUT要靠經驗的!!!加油2 y& Z: U$ b7 W% i9 E
LAYOUT要靠經驗的!!!加油2 o. t0 p: ?' A9 n$ U+ g% C# u
LAYOUT要靠經驗的!!!加油
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