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最近正在嘗試設計一個op,所以對很多問題仍在學習,0 w# }0 D3 B9 I; r9 {) W k+ d
希望各位不吝指教,以下是小弟目前遇到的問題9 t; }- c* I, c' k
( a# p) H; @$ U(1)要如何利用Hspice量測一個op最大的輸入和輸出擺幅,指令應該如何下?! E# C: ]3 ^ i0 u2 }2 S: {. b$ \1 |
1 Q9 y3 n% M2 l(2)對於一個摺疊疊接的opamp,其輸入的差動部份,可以用NMOS或PMOS來構成,哪一種會比較好?
* e4 L+ g3 W, ~9 a; l 如果使用兩組NMOS和PMOS的差動對來做輸入端部份,是否就稱作rail-to-rail的op,輸入擺幅應該就會比較大吧?
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- G- c f2 C7 e" h(3)關於量測op時,好像都會考量phase-margin多少的問題,應該就是
: X _9 [" A' a 量測時增益為0dB時對到的Phase再加180,不過為何要再加180?2 Q8 }( f' {0 I
而所得的phase-margin的值又代表著什麼含義?
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(4)設計op時,好像會在輸出部份加一個補償電容,這又是因為什麼?
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: u# x0 H2 M" j2 }# @小弟初入門op,正在學習中,所以問的太基礎,還請各位前輩多多包含, [4 O# Y3 x' M2 r# w5 Q
麻煩了,謝謝。 |
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