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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › N+/P+ poly gate
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[問題求助] N+/P+ poly gate

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1#
發表於 2007-10-2 13:47:57 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
有誰知道design rule中 Frond-End Features部分所提到的% G6 }2 f" V( l' q  B/ ^& o1 @+ [7 G
N+/P+ poly gate
. _  L% v  ?% E& |5 FAllows symmetrical design of NMOS and PMOS devices" @+ |: V% [) a3 k9 g
# I) s* Z4 R# H2 i+ I# p  c
那是什麼意思，請不要告訴我英文翻成中文的意思
, Q0 U) p4 L& K: j  z, N: ^+ h$ r0 E我想討論他的真正涵義
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