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[問題求助] 求助!畢業專題為設計全加器,希望大大提供經驗

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1#
發表於 2007-9-10 01:31:25 | 顯示全部樓層
1. 所謂高性能,除了1.)功率低、2.)工作速度快(總傳輸延遲時間短)、3.)扇出數多& B3 p# ]9 K% r* a
其實應該還有一點就是面積要小(或者所使用的元件數要少)
3 f0 i1 z4 q. b( j9 z不過,補充一點個人看法,扇出數多並不太算是高性能的特點之一,因為只要在最後一級輸出加大其size便可
5 i. Y# s7 P: t/ E
4 F' u5 J0 q& A6 F7 ^4 B( a2.其實,想要達到工作速度快的話,其W要加大,L要設為最小,同時,PMOS:NMOS的W比例值應為2:1(或者2.5:1), [4 S/ _  h7 y3 m
而至於工作速度最高可達到多快,這點需要作SPICE模擬才準確,再者,不同的製程有其不同的最高速度限制,至於極限為何,還是得作SPICE模擬才會知道
- |+ C6 O4 w: Y; Q至於功率要低的話,除了元件數少之外,另外一點則是從電路本身著手,這點對妳來說可能會有點困難,基本上如果妳能夠降低暫態電流的話,其功率也就能夠很明顯的減少0 A5 u! G: E5 z1 I4 l0 @7 ^

, T6 h1 H* Q( h' u' A+ d3.我不確定妳能不能夠借到這本書,英文書,書名為"CMOS Logic Circuit Design",1999年出版,作者:John P. Uyemura,書中的第6章是介紹Transmission Gate Logic Circuits,裡面的第4節有用TG OR和TG XOR及TG Adders等電路及其說明,我想應該就能夠回答妳的問題了
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