一些Layout的問題

okfunny

关于 double guardring,我们的画法是 ntype ring 靠近噪声源
就是说 如果包的是噪声源的话,ntype ring 在里面,如果是为了防止别的噪声干扰的话,ntype ring包在外面

wendyamy8570

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2 ~  O: i4 V& v0 x# N非常感謝大大的分享
% l! B+ I9 Z. c非常感謝大大的分享

semico_ljj

原帖由 finster 於 2007-9-6 10:31 PM 發表
我是在一篇paper中看到的,不過這篇paper不知被我放在那裡了
另外,你所引用的教課書的公式應是Razavi那本"Design of Analog CMOS Integrated Circuits"中第13章的吧
書上是先決定BJT的顆數比,然後再求出相對應的電阻 ...

6 K- |* h& u5 x. w好像实际确实如此！谢谢！ ……………………………………

laker１０１

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/ I/ x! M$ o& y非常感謝大大的分享
" {- P' }3 d8 g" Q非常感謝大大的分享
- n3 @- W8 ?) r0 Y( A) W0 |常感謝大大的分享
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lethalkiss1

1    普通的logic电路影响不大，  不过一些高频信号， 一些delay电路等的还是尽量避免
* q4 |8 L6 G& d
; P% z/ f; r2 u1 N6 D, a2    guard ring 最有效果的是p + guard ring，  但是一定一定一定要接到干净的gnd！！！， 这样才能吸收掉noise。  2种都画的话，比只要p+ 好一点点。

3  这个是为了匹配这样设计的，一般都是设计成1：8    ，1：24 。

gyamwoo

最近在做ｐｌｌ的電路。類比數位都會用到。
$ w3 K$ v1 _# }& m各位都好利害啊，每個回文都有參考價值呢∼∼

kstcandy

剛好要瞭解這方面的資訊，正好做來參考...

謝謝分享...

091234567

非常感謝大大分享~
" t& q/ i/ S& D" t% @) ^& N3 I非常感謝大大分享~
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lnxmj

2：pring 接地收集空穴，nring接高电位收集电子，二者纵向结深越深越好；多子ring是为了让sub电位不被拉高或拉低，少子ring收集电子或空穴

段睿閩@FB

謝謝各位前輩的經驗分享

alfie.chuang

1
怕千擾
: g( Y3 `: |/ ]% E6 u可以事先詢問rd care的地方，避免跨過即可
2
依pnmos來決定第一圈及第二圈ring
3
我也是畫9官格

188

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) b9 D& `7 e# D: h- M非常感謝大大的分享