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原帖由 monkeybad 於 2007-8-28 10:40 AM 發表 ![]() $ t! _4 q5 N0 W: Q. p- q7 m
如題+ E: _8 t+ T8 w1 d& `5 _ ?/ @) E
小弟我目前在設計一個時鐘電路 需要一個記數器 不知道這個問題是不是屬於這個討論區9 G# c+ {- g5 X9 o' G/ C- b* L
如果不是麻煩版主修改一下囉, E2 C1 M- C! V9 p
7 S* @& X' }1 v6 u
目前這個記數器要能數0-9 接著就進位 然後自己reset繼續從0開始 進位後訊號再繼續由一 ...
# C5 M, s6 z/ a; ~1 p2 e5 T4 y
大大您是要寫Verilog還是電路# [) l7 K3 c$ u, f" [; R
4 O- `, l4 z! ? P- z. n, `+ Q% X$ h
先PO個RTL Code參考看看- I9 o6 S: }, Q; X1 W- B
+ U+ W" T4 t6 q8 O- D
輸入：N clear load clk% e) n2 t2 ~/ T% y. Y! s8 I
輸出：count/ p( S1 x, c( F9 V
7 O0 t" n+ e& Y
行為描述(依照優先順序)% Y/ j: T; U4 s# V
1.如果clear為1，則輸出設為為09 S9 n7 G8 y; X( [6 o
2.如果load為1，則輸出設為N
% b+ s1 N# x z/ t3.每個時脈輸出遞增一次(BCD)
) z2 Y: {7 B$ d. V- @
: `% [: S8 ^7 V6 |0 P![]()
$ I( m6 j5 Z. N/ s9 M3 s& V" J4 L9 m6 u% h7 T0 {9 m$ Y) u& J
程式碼：
) `6 [" R3 |9 cBCDcounter.v% p; T. |/ |. G0 l& B
, ^+ H4 b3 H9 S7 `module BCDcounter(clear,load,clk,N,count);# h' N- f. O; q
input clear,load,clk;$ `9 J% ~* L7 f9 L9 u- v$ w
input [3:0] N;; `2 V; N! D# Z/ ?9 b
output [3:0] count;3 G4 ^- V) K3 M/ I5 A6 b
reg [3:0] count=0;$ P) V8 z/ x8 K8 Q
% c; {; Y7 \& {# S( S
always @ (posedge clk) begin
+ B6 j0 p# q( j" e; _; X. W if(clear) //clear=19 H% \3 b& f# B! g, x, k. c
count=0;& ~* c7 c0 f4 [0 i1 c! z
else if(!clear) begin //clear=0(共有0 1 X Z四種狀態)* q" I8 z- X2 Q7 r
if(load) begin: a8 E1 o1 N: l4 y9 M
if(N>9)9 S6 A/ T' Q. |
count=0;
P9 x* ]4 A* e& g$ Y7 A! G6 e else
, s+ S1 a( S2 r% D t count=N;, y% y8 K( k$ N: u7 @) F
end
% S6 B7 z, [4 w9 g else if(!load) begin
+ o$ Z5 D" p; H count = count+1;
& ^( g. S7 l4 Z2 F+ i) U if(count>9): Q2 {+ O" y- H
count=0;5 g) G" C4 B0 E. M$ M
end9 Y: @$ g9 H0 \) q0 k
end( J q1 |" d" I+ b: M2 Q
end
' @3 m; j/ g; v: g6 g" D. Aendmodule6 M# P5 x8 w$ t& o# q
: E' E+ I: `% @# A1 r/ ]; @% x
bcdcounter_tb.v F3 s! h9 M5 z* Q( p
$ B" R7 M& j3 v8 k1 ?# Jmodule bcdcounter_tb;
2 Q6 ?0 g4 e7 Rreg clear,load,clk;" T& d. R1 T0 T! R
reg [3:0] N;
& A3 O% l8 c9 p& u, W! Hwire [3:0] count;; h& b. H( t; l2 I: e. R
7 v. K3 c0 e) z. \. d5 J g
BCDcounter m1(clear,load,clk,N,count);$ I0 \: k( t5 |# p7 `6 \
9 ]# _3 G8 Q8 f- q! k. M1 u! ~initial* j+ f; n/ d6 b7 M9 v7 t
clk=0;
7 ^' c& n+ e, M) p3 e6 o. P! ]) F, N3 j2 S$ O6 P& q; Z4 V+ w5 P+ L* ]
always #2 clk=~clk;
% K8 \7 l" M4 F4 N0 G$ B* s
7 k- h& T& w: e6 \* ]initial
" k% K2 n* c2 k4 d+ M4 m( l# l/ }: P#160 $finish;
" ~- e, n, \" z4 s) |) n8 g) {& q2 G# G2 D
initial begin( o+ z! o/ K) a: M7 P- {6 A4 x! s" Y
clear=1;
: Z; { d2 i0 G# Q( I& n#4 clear=0;
; N" n( c! J. k" B2 w#90 clear=1;) v( ^1 G1 l; D! t
#3 clear=0;
4 d/ b( T. s5 f. Wend
5 H3 Y2 \: C9 y
5 \& S: F, a4 E/ Cinitial begin8 O' u+ g" r) r0 E8 d5 K
N=6;load=0;
2 x4 K, ^" e+ g+ s8 k* v: ]$ C8 S( {#58 load=1;. C7 U& U8 q4 Z4 l7 C: b' e# @
#2 load=0;5 ^7 V1 o' l- G* Z6 e
#22 N=12;
: w" l) L, q2 z/ W/ E( t- U#40 load=1;
6 k" l5 s( x' |! v M& k: ^#2 load=0;8 E' Z' L9 w/ f+ T$ }' R$ i1 ?
end R) M9 p# k" H+ i. ]& A
2 t( u% `0 e/ M# }- w: `# H, uendmodule |
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發表於 2007-8-28 10:40:06
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