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介绍了一种高速7 位DAC 的设计及芯片测试结果, 该DAC 选取高5 位单位电流源, 低2 位二进制电流源的分段结构。考虑了电流源匹配、毛刺降低以及版图中误差补偿等方面的问题来优化电路。流片采用0. 35 um Chartered 双层多晶四层金属工艺, 测试结果表明在20MHz 的采样频率下, 微分非线性度和积分非线性度分别小于±0. 2 L SB 和±0. 35 L SB。该DAC 的满幅建立时间是20 ns, 芯片面积为0. 17mm ×0. 23mm。电源电压为3. 3 V ,功耗为3 mW。