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樓主: jauylmz
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在Layout時最花時間的工作是....

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21#
發表於 2007-12-25 09:32:04 | 只看該作者
1.我也認為 floor plan 最麻煩,因為一個好的 floor plan 除了能讓訊號線走的順之外,也可以節省面積4 M& a8 d1 B2 P3 h) e% W
2.接下來我覺得比較重要的是 power and ground line 的跑線,因為要走的順才是最重要的,而且若POWER途中一直換線其實也會降低它的電流; c* ~* t) F: p2 g% @+ t8 J# d
3.接下來我覺得都還好,因為 DRC LVS block 刻好就會 RUN 了 ,另外create block本來就需要花一點時間
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22#
發表於 2007-12-25 11:52:01 | 只看該作者
如果位置沒有排列好ㄉ話!面積會變大∼甚至拉線會亂七八糟ㄉ∼
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23#
發表於 2008-1-27 11:14:54 | 只看該作者
最花時間的應該是  給你的空間不夠
1 _- Q: y4 p4 y8 Z% U你勉強把東西 塞進去之後  好不容易做完9 S$ N! x* \7 ~" R0 a
結果電路圖又變了  你就完了
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24#
發表於 2008-2-5 20:17:01 | 只看該作者
以我們公司來說
( d& T9 m( H! F7 S  D" ~2 i一直改圖對LAYOUT來說是最花時間的
( ]$ q7 M% X9 _8 c+ o) T' `或者是 沒有看清楚 RD寫的NOTE/ o2 a$ f" F" e& Q: @2 `+ \
導致LAYOUT雖然能過LVS 但是LAY法卻是錯誤的4 ~3 G" f  u% a
  b+ U4 E( u# J* l* e- \/ \3 |% H
有時候我們公司RD也不想讓LAYOUT一直改
# @% }/ {1 s% ?. N5 @; P, B只是因為有時專案太趕
4 ~6 a0 ?' V, S所以只好跟LAYOUT同時平行做
+ s9 e) i1 ^. x這樣就容易電路常常會大翻盤
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25#
發表於 2008-3-19 13:01:26 | 只看該作者
我是選擇排列~~~' U9 R! p! t* f1 M
光是排列就會影響後續走線9 t$ B& |. s3 p
所以要特別注意~~~
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26#
發表於 2008-3-25 09:49:52 | 只看該作者
元件的排列、拉線都會有很多要求之類的. g( d- s& w4 q; k& j
最辛苦的就是改圖~原本己經畫好的,但是rd突然說要改圖
; \7 H& O. v7 M7 f然後整個的大小不變,但是改的地方,又比原來的大一些
8 P& v6 _- r# `- j% X+ |5 O這是最麻煩最痛苦的
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27#
發表於 2008-5-26 22:19:14 | 只看該作者
Re-layout往往是floorplan做得不好,所以floorplan是很重要。
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28#
 樓主| 發表於 2008-7-9 18:34:24 | 只看該作者
Chip Integration    可以算是拉線和DRC/LVS 嗎
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29#
發表於 2008-9-9 09:36:20 | 只看該作者
其實上述所有選項都基於兩個字 : "溝通".如果與designer溝通不良,即使畫的像藝術品一樣,花的在久精神部局與除錯,只要designer說不是他要的,一切枉然,全部重來.
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30#
發表於 2008-9-10 14:56:03 | 只看該作者
以上皆非
) r0 l9 l8 f: ?. a2 g& k5 r1 o- E* g* ]& a- L  _  ]
我花最多時間的是在思考,2 ?5 A& S' g+ T! ?0 i3 J2 ?
一個5天該完成的案子,我可能會花去2~3天思考
/ O9 t1 i, t0 d/ r" A事前想的仔細,
3 ]3 v/ d7 ~2 z7 s開始動手layout一直到驗證完成都會很快而且順利。
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31#
發表於 2008-10-23 16:34:30 | 只看該作者
都很耗時間!!!  只要 動手 下去做  都是 耗時間!!!  哈哈~~~  用呼叫的 自動拉線  才是王道~~
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32#
發表於 2008-10-27 17:07:49 | 只看該作者
布局和整合最难,最能体现实力!。。。。。。。。。。。。。。。
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33#
發表於 2008-11-9 00:01:28 | 只看該作者
我也認為排列的部分還是會花費較久的時間,可能是因為剛接觸Layout沒多久,經驗不足顯得更無力!' G3 N# K; E9 \! k
整合這部份,如果是自己獨立一人完成,雖然時間耗費較多,但是就跟寫程式一樣,如何去安排自己的line能走得順( ~& `! P( V6 T( ^  W, I/ E
我想這才是最重要的!重點一句:還是經驗比較實際吧
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34#
發表於 2008-11-18 11:04:16 | 只看該作者
有不花時間的嗎& ]1 H0 ]3 M6 h: Q7 P1 W
LAYOUT我覺得每項都很花時間# j4 i6 f, H5 O% O/ g) @
不管是佈局還是LVS/DRC' j5 n3 Q+ c# V/ I
每項都得小心翼翼
- g6 q2 Z/ I% F6 e  q做快不見得好; w* m/ J$ N' m" E& F  C
做對才是重要
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35#
發表於 2009-4-9 01:03:28 | 只看該作者
我也覺得 floor plan 最麻煩~( U, `! H$ J' ^  J, i' M' }
因要如何將每個block充分擺到適當的位子~
5 i) k/ I. v! `$ `$ m) a% S這是一種學問~$ `* K" u7 e) D' g: o  l, V8 ]7 b
因擺的好的話~
* I& b  e( B  _其他的閃線或拉power一切都還滿ok的
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36#
發表於 2009-4-24 13:19:48 | 只看該作者
2.  排列 Placement   7 v- m2 p% x/ f4 `/ L
6.  整合 Chip Integration' `! b1 d. c  ]8 H: C4 t
7.  溝通 communication5 Z3 {2 p. y* O& Y5 E
這三個最麻煩
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37#
發表於 2009-6-27 01:02:39 | 只看該作者
排列最花時間吧
1 z" q( b, |, G: w
* Z. f- g$ ^( K6 U在layout初期就要花很多時間先想好如何排列
% R! I4 L2 O* ~1 p( y
* {  w: t+ @) v0 W1 y1 z想好後,反而才會省下大量的時間
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38#
發表於 2009-7-4 12:07:08 | 只看該作者
位置該怎麼擺真的需要一開始的計畫...
9 F, D: Q( w$ I. A% d' M. I要不然最後會發生難以挽回的錯誤啊>.<
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39#
發表於 2009-7-8 11:56:51 | 只看該作者
floor  plan比較花時間  只要floor plan 做好   
9 C( `5 a) P# `
3 _4 W5 l5 X/ u! e其他就會很快   相對LVS 問題也比較好除錯
$ v6 N( }  ~8 ]2 A( @. _7 L7 d2 ~& n
; Y, A2 \) ~! @% y. PHR.概念有  應該DRC LVS比較不會有問題吧
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40#
發表於 2009-9-3 09:08:46 | 只看該作者
我覺得placement和溝通是花最多時間的,因為會決定你的做法和拉線的容易度,( R* r9 v2 z! C) \
再整合時也會是另一個問題
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