Open-Silicon選用Virage Logic Core-Optimized IP套件

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-- SiWare(TM) Memory, SiWare(TM) Logic, SiPro(TM) MIPI and Intelli(TM) DDR 伙伴關系將中芯65納米低漏電工藝至臻完善

美國加利福尼亞州弗里蒙特和中國上海2010年5月24日電 /美通社亞洲/ -- 備受半導體產業信賴的 IP 供應商 Virage Logic 公司 (NASDAQ:VIRL) 和中國最先進的半導體制造商中芯國際集成電路有限公司（中芯國際，紐約証券交易所交易代碼：SMI，香港聯交所交易代碼：0981.HK）今天宣布其長期合作伙伴關系擴展到包括65納米（nanometer）的低漏電（low-leakage）工藝技朮。根據協議條款，系統級芯片（SoC）設計人員將能夠使用 Virage Logic 開發的，基于中芯國際65納米低漏電工藝的 SiWare(TM) 存儲器編譯器，SiWare(TM) 邏輯庫，SiPro(TM) MIPI 硅知識產權 (IP) 和 Intelli(TM) DDR IP。這一聯合協議是 Virage Logic 與業界領先的代工廠業務擴展戰略的一個組成部分，也是中芯國際承諾為其客戶提供一個完整的 IP 解決方案的兌現。
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“作為中國首屈一指的代工廠，我們與 Virage Logic 公司拓展合作伙伴關系將使中芯國際能夠提供更多業界領先的65納米低漏電工藝的半導體 IP，這不僅能滿足來自中國本地的系統級芯片開發人員的需要，亦將助益我們開發全球半導體市場。”中芯國際資深副總裁兼首席商務官季克非表示。“目前我們已經有一些客戶正積極利用中芯國際的65納米低漏電工藝及 Virage Logic 公司相關 IP 進行芯片項目的開發。我們期待持續發展與 Virage Logic 的合作關系，不斷滿足日益增長的市場需求。”

0 L; o7 ?  ]/ K1 G“我們很高興能夠在65納米低漏電工藝方面擴大與中芯國際的伙伴關系。Virage Logic 開發的業界領先的 IP 產品將能夠讓更多的客戶選擇中芯國際作為他們65納米制造的主要供應商，” Virage Logic 公司市場和銷售執行副總裁 Brani Buric 表示。“作為代工廠贊助的 IP 產品計划之一，我們的 SiWare(TM) 存儲器編譯器和 SiWare(TM) 邏輯庫將免費提供給終端用戶使用，中芯國際對此充分肯定其戰略意義。除此之外我們的 SiPro(TM) MIPI 和 Intelli(TM) DDR 標准高速接口 IP 也為用戶提供了一個經驗証的解決方案，使得各地的設計師都能在他們的65納米低漏電設計中選擇世界一流的 IP。”

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關于 Virage Logic的SiPro(TM) MIPI IP
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% s" L  ~& \* q$ @* n. I1 `SiPro MIPI DSI（顯示串行接口），CSI（攝像頭串行接口）控制器以及物理層 D-PHY，在保証良率的同時，提供性能、面積、功耗的優化方案。SiPro 為移動設備攝像頭和顯示接口提供無縫連接方案，并已通過系統級驗証。該 IP 方案被大量應用于移動 SoC，已在65低電壓工藝經過產品驗証，并可用于40低電壓工藝。

  Z8 K+ O/ D' p, h8 B1 X關于 Virage Logic 的 Intelli(TM) DDR 接口 IP 解決方案

. e) B, }/ X- K8 ^+ cIntelli DDR 存儲器接口產品擁有為 DDR1，DDR2，DDR3提供最好性能，最低觸發時間的智能存儲器控制器﹔最低功耗，最大帶寬的移動 SDR，移動 DDR，低功耗 DDR(LPDDR) 以及 LPDDR2存儲控制器﹔并為 DRAM 提供高速、全數字 DDR SDRAM PHY+DLL 方案以及先進的高可配置型 DDR IO。與模擬方案相比，全數字的 Intelli PHY+DLL 方案最多可節省25%的功耗，并縮小多達20%的面積，為高性能、低功耗應用提供優化的硬核方案。

1 F  B: |5 D# Z, L) ^6 L關于 Virage Logic 的 SiWare(TM) 存儲器和 SiWare(TM) 邏輯產品

于2007年10月首次推出的65nm Siware 產品線，可滿足先進工藝物理 IP 日益復雜的設計要求，目前在40nm 工藝已有超過40家客戶。該產品線能針對先進工藝，提供優化的功耗方案，最大程度降低靜態功耗和動態功耗。Siware 高密度存儲編譯器能產生最小面積的存儲器。Siware 高速存儲編譯器能幫助設計者解決最具挑戰的關鍵路徑要求。工藝極限變量的編譯時間選擇，省電模式，讀寫余量的擴展，超低工作電壓，創新的 at-speed 測試，能幫助 SOC 設計者配置出最優化方案。

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所有 SiWare 存儲器皆完全支持 Virage Logic 公司的 STAR 存儲系統。STAR 存儲系統為該公司的旗艦嵌入式存儲測試和修復系統，可并用于 Virage 邏輯存儲以及內部開發或者其他商業用途。為便利修復，該 STAR 存儲系統使用代工廠開發的存儲 eFUSE 以用于修復署名紀錄的存儲。STAR 存儲系統采用專為先進工藝量身定制的測試算法，以提高產品可靠性及加速產品的高良率周期。
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# W0 s9 N7 ]: D) m/ a) m3 S& hSiWare 邏輯產品線針對高性能，高密度需求，特別量身定制高性能，高密度標准單元庫。該單元庫包含超過1,100個基礎單元，提供多通道配置以及不同的極限變量，能快速達到時序終止，同時不影響面積和功耗。

7 c# ^% M/ w2 |$ [Virage Logic 的邏輯庫通過對更嚴格的設計規則、更高的可制造性以及更好的電遷移可靠性標准的不斷追求而達到良率的最大化。通過統一均衡的版圖設計，使用非最小化尺寸器件使得局部的變化達到最小，并且其特性可被代工廠相應的抽取環境所精確反映。比如，能夠反映出阱鄰近效應，相鄰電路擴散間距等 DFM 效應。
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9 p( K2 N! H6 F. P# X8 d# N供應情況

! F, ?5 c" O; UVirage Logic的SiWare(TM) 存儲器和 SiWare(TM) 邏輯產品將在2010年第三季度上市。在代工廠 IP 贊助方案的支持下，Virage Logic 將直接授權給代工廠的終端客戶使用。
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7 c) b, m6 f2 b) y( a- g2 V: DVirage Logic 的 SiPro(TM) MIPI 和 Intelli(TM) DDR 接口 IP 將在2010年第三季度初上市。

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Virage Logic 持續強化半導體IP方案 推出全新處理器周邊核心
首度展現NXP智財技術，完美整合Virage Logic的ARC®處理器與介面智財產品

台北 ─ 2010年7月1日 ─ 廣獲半導體產業信賴的智財夥伴Virage Logic公司(NASDAQ:VIRL) 宣佈進一步擴充目前已相當完備的半導體智財(IP)產品範疇，推出全新的處理器周邊智財，包括UART、USART、GPIO、SPI、I2C、General Purpose Timer和Watchdog Timer核心。這些業經生產驗證的核心產品，是Virage Logic於2009年11月併購NXP公司先進CMOS IP產品線之後的第一項貢獻。這些新核心搭配測試工具(協助簡化SoC驗證)和軟體驅動程式(簡化處理器程式開發)以加速系統單晶片(SoC)的開發程序。在這些新核心推出之後，Virage Logic計畫在今年稍晚陸續發表一系列相關產品。  

( r6 w0 s% N. A8 I% _6 KVirage Logic處理器與SoC方案產品行銷總監Mike Thompson表示：「自去年底併購NXP處理器周邊事業群以來，我們投注許多心力將所有業經矽晶驗證的元件予以產品化。這些新核心的推出，彰顯了Virage Logic不斷擴充的產品範疇，也讓我們成為業界單一來源最值得信任的IP供應商。Virage Logic今年下半年將推出一系列子系統與基礎設施IP，隨著我們不斷擴充的能力，我們能為今日SoC設計業者提供更多的整體解決方案的選擇，協助他們克服越來越具挑戰性的上市時程和利潤目標。」

市場研究機構Semico資深市場分析師Richard Wawrzyniak表示：「隨著IP再利用率的提高，使用於每一項設計的IP模塊數量也跟著增加。這些IP模塊有越來越多是用在通訊介面、類比模塊等非CPU或記憶體功能上。這個趨勢最大的發展助力也許來自一個簡單的事實，設計業者為了能夠準時完成他們的設計，必須採用他們熟知的IP、也必須尋找可信任的IP供應商。」

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這些新周邊核心與Virage Logic已位居領導地位的一些市場區隔需求非常契合。其中之一就是快閃記憶體，Virage Logic的ARC處理器在USB快閃記憶體市場擁有最大佔有率。WiFi則是另一個主要市場，Virage Logic的ARC處理器在目前的筆記型電腦和小型筆電WiFi控制器市場中也佔有相當大的比例。再者，這些周邊也讓Virage Logic的ARC處理器方案在8051汰換市場中更具吸引力，Virage Logic特別針對這塊市場主打最新發表的ARC® 601處理器。

/ P+ J/ G: {9 x6 _關於Virage Logic新處理器周邊智財

Virage Logic的首批處理器周邊智財包括七種產品：

l二款串列介面核心

-I2C (Inter Integrated Circuit Interface)

-串列周邊介面(Serial Peripheral Interface; SPI)

l二款UART通訊核心

-通用非同步收發器(Universal Asynchronous Receiver and Transmitter; UART)

-通用同步非同步收發器(Universal Synchronous/Asynchronous Receiver and Transmitter; USART)

l一個I/O (Input Output)介面核心

-通用輸入/輸出(General Purpose Input Output; GPIO)

l二個計時器核心

-通用計時器(General Purpose Timer)

-看門狗計時器(Watchdog Timer)

供貨時程

處理器周邊智財核心現在開始供應，授權條款和價格資訊請洽詢Virage Logic業務代表。

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