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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › EDA 設計討論區 › 電路模擬上最頭疼的問題
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電路模擬上最頭疼的問題

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1#
發表於 2006-10-19 09:43:41 | 顯示全部樓層
大家好,8 D2 u7 ]) |' r' W/ C
  Z% a' d5 z9 r
我是 NB EE Simulation engineer.$ c4 l4 k5 c& E4 `- U
我覺得最大的困擾是 有些資料無法從 IC 提供商那邊取得 % }$ S, n! F- {4 c9 G2 c* n- P+ N
(例如 IC Package Model with power/gnd effect 對Power Plane 是理想的設定下 是不需要上述的資料 可是要做 SSO/SSN 或 Power Integrity 時 就很需要這些Data.)) a5 i9 m8 b9 [5 Q# j2 j8 _
; ]! V3 i" R  J
資料或模型不足 很難做到後續EA的驗證~9 K) ?% ~0 D; e: x
1 d1 j& F' R" c5 e6 o' p; B; D
這是我目前 做困擾的事~

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jiming + 3 是 需求 救要不要客氣說出來!?

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