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[問題求助] 請問一下,layout的方式

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1#
發表於 2008-12-26 12:07:01 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
小弟前陣子換了家公司,發覺所有的layout觀念都變得不同了1 @, |/ J; E9 }- g% i5 q: R
像現在的要求就是你面積要夠小,然後拉線的感覺就是只要拉對 lvs 過就好
  X2 Y" l0 Q" r4 d) tmos上面,可以直接飛越過去,不管是類比及數位的,像這樣子的layout方式# u2 s. y- E8 R8 Q
對於電路的特性那些會受到影響嗎???.5 .18的製程/ }, f- r* {" p
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2#
發表於 2008-12-26 12:49:40 | 只看該作者
你那是针对Memory的Layout吧,Analog的话性能还是比较注重的!
3#
 樓主| 發表於 2008-12-26 13:46:13 | 只看該作者
沒有呢,我畫過的adc及osc也是這樣子
4#
發表於 2008-12-29 09:24:08 | 只看該作者
不管是黑貓白貓; h7 ?5 ^3 {: T/ f2 k
會抓老鼠就是好貓
6 A' X9 N2 }$ k  e不管值拉橫拉
# K  Y' B. U$ P! z) r' O能 work 就是好layout
5#
發表於 2008-12-29 17:32:41 | 只看該作者
要留意一些比較noisy 的signal / power是不是走過一些較脆弱的analog block上; t9 ^: x3 U) r9 d
隨便畫的話,analog有問題的話便很難debug和驗證了- Q- n0 L5 q0 I, @. U! Z6 g
畫layout前最好問清楚designer那一些signal是雖要特別的shielding功夫
6#
 樓主| 發表於 2008-12-30 11:27:45 | 只看該作者
我的上司,只要求最小,不要浪費空間,只要小不浪費空間: t1 ^3 m& `7 u8 G8 k( m
mos上面,我看過滿多前輩畫的,都是跑滿線的!!!% \# e! t# C! c% b/ |8 [
所以現在我越做越迷思了,像這樣子的話,是不是就不用考慮到電路的效果了??- D( M6 G3 L+ I. I, u
只要mos該match的有到,其他拉線跑線的話,拉對就好???
" X, d7 }" R" _+ s' T- f  [如果是這樣子的話,那年資就有用嗎??% e) T" t3 G9 V/ n
8 k1 E' K& v) l4 B! ]) d
[ 本帖最後由 ynru12 於 2008-12-30 11:30 AM 編輯 ]
7#
發表於 2008-12-30 16:04:24 | 只看該作者
我想是不同公司有不同的要求,可能它們的設計要求不太嚴謹
+ R6 a" f1 Z2 c% p" w1 P& T# p如果他們只要LVS match,那麼年資和學歷也不重要了...
) X* g9 L7 u" q! S請問貴公司是做什麼產品呢?
8#
發表於 2008-12-30 16:16:32 | 只看該作者
原帖由 motofatfat 於 2008-12-29 09:24 AM 發表
( T* C+ Q* h3 L- S不管是黑貓白貓
. y# ?4 [' C+ G 會抓老鼠就是好貓1 }- O0 G( _4 d; }% z8 d) Q
不管值拉橫拉
8 \4 ]( q; g0 _( L! `0 d& m/ U能 work 就是好layout
) U0 g) e/ Q& u/ S& ~: ~) l

1 @( W) S3 T3 Y# r  R, W" X我上個主管也這麼說過呢
2 {/ R4 a2 F# O6 Q9 D$ q4 [所以儘管當初我畫的不夠好
3 q: ~% L- |1 u0 _. ]他說能賺錢就是good job
9#
 樓主| 發表於 2008-12-30 16:57:37 | 只看該作者
如果只要可以工作的話
9 i% ]6 h8 Y7 ]2 x3 x3 F但是效果很差,這樣子也算是好嗎??  G, S* ]' b3 O
公司做的東西滿多的,有一些產品的控制
& G5 q4 ]% e& p! ~# `- O5 x& {製程大約在.5~.18之間
10#
發表於 2008-12-30 18:40:45 | 只看該作者

回復 8# 的帖子

這樣我相信'賺錢'只可以維持短時間... 長遠來說, 對公司一點的益處都沒有
11#
 樓主| 發表於 2008-12-31 00:28:30 | 只看該作者

回復 7# 的帖子

是滿廣大的,有影響、音效、鍵盤、會跳舞的狗、微波爐內部的某塊
12#
發表於 2009-1-3 12:51:09 | 只看該作者
MOS上能不能跨線* T7 @% r- @% m3 e5 }3 B% I
# W% B" B) F" y9 x0 K/ X, W' n
目前以我目前所知的~~是依製程跟產品上來# {9 H% F% ^6 I* E/ J  U6 t5 ^

  k8 I8 [/ H, D做區別~~一般高頻系列的產品對於MOS的特
6 e6 b; w5 U' V
3 p9 f" Q; K6 n性比較要求~所以除了MOS MATCH之外也會* ~/ M, ^; |% m" [' F

$ _; ]* \" G' X; ?3 G1 f5 d對連線上做出一定的規範,低頻的產品就沒那5 d( C/ w! [5 u  R9 L. G* F0 V

1 b, s7 Q& E4 ]麼考究了
13#
發表於 2009-6-19 16:12:46 | 只看該作者
這問題我也碰過
$ }, K% x) l0 o" c看主管想法
# J7 x6 r( u+ M4 n* E也些會考慮很多製程特性一堆問題
" d: W) h2 `$ [5 \4 O$ V8 A; ^. z有些就你只要在時間內畫好管你畫的怎樣* i- I! c/ k5 _% f2 ~; y
只要LVS過就OK
2 y) ~/ N. U  [% J2 ~' S0 |: _8 j所以我也看過很多離譜畫法
14#
發表於 2009-6-20 00:59:05 | 只看該作者
我看前輩lay的很多也都蠻神奇的) y- [# J$ H/ |# f# M( f1 [) e7 W2 X
MOS方向不同、沒guardring、或者guardring沒接power- y  t: `+ S) Y. w5 u+ }. {
...via越多越好,結果也都只打一顆,整個block就是亂..., U6 m" [6 S3 E1 p; U5 d5 L7 S' G
但是...能work
15#
發表於 2010-5-21 11:59:41 | 只看該作者
能work就是好芯片,哈哈
16#
發表於 2010-5-21 18:58:50 | 只看該作者
話說....
+ I8 H/ D" p9 K: a/ ~- K曾經有人看過某家公司的layout
$ a# M' i- D5 H就決定不會買使用那家晶片的產品了
17#
發表於 2010-5-24 11:16:50 | 只看該作者
能賣就是對的~~~~~~~~~~~~~~~~~~€
18#
發表於 2010-5-28 16:50:59 | 只看該作者
真假??0 [7 }6 J$ |0 z

1 H% x! \" M* x1 P光聽到飛過mos我就嚇到說!!呵
19#
發表於 2010-6-2 11:19:34 | 只看該作者
有些上司根本就沒觀念及概念
; }6 u! i: b& {9 L/ N. l$ W8 k只要求面積小時間內做完
' u/ Y  ~8 k. Q7 {" lLVS及DRC   OK!就好
: Q5 B' K$ {8 g5 _: O' Q所以一開始不能適應( \6 X) E. n, k+ F% c/ U
能WORK就沒事2 ^' k1 Z  c* m; Z+ A! W0 y% Y
但如果不能WORK說不定就推到LAYOUT身上/ u$ j- I* e; w5 _& A- ]
就會說怎畫成這樣等等~~~~
20#
發表於 2010-6-8 20:06:42 | 只看該作者
多一分常識囉!!0 Q4 i8 s8 v3 _' h
1 K/ s$ e# X3 v  q7 D6 s% j
感謝各位的討論阿!!!
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