[問題求助] 為何視同一條timing path

[複製鏈接]

sieg70

1^#

發表於 2008-9-22 10:46:30 | 顯示全部樓層

一般ROM是用LUT一類查表的電路來實現, 所以在看timing path時會由sync SRAM直接看到FlipFlop,
至於你電路的sync ROM(?) 可能是ROM加上register input/output, 這東西很可能在合成時跟上/下游
合併, 建議你仔細看一看你的log檔, 或是technology view, 看是否有作化簡的動作

還是你方便將這段code post上來給大家合成玩看看?

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