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樓主: 0918429587
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[問題求助] 關於ESD input and output pin 保護電路設計

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21#
發表於 2010-5-10 14:38:41 | 只看該作者
Per my experience ,Diodes + RC-Control , inverter and PowerClamp is better for out pad
9 g- k3 D& x3 Y, W6 L2 \* D6 CGenerally speaking ,the root cause of ESD failed is from below.
" A. y: B2 R  U# A- [<i>clamp NMOS's ability.
1 s7 X/ K  O- F! T) d0 E<ii>clamp NMOS's turn-on rate.) G% n6 v2 W  r( c7 P7 M  [9 i0 k7 [" @
<iii>Not follow design rule......................./ O/ Z  Z& l4 V8 W- r7 a# m2 T# k5 g
As we know ,RC-control is to keep clamp NMOS off when IC is on normal operation.(us)
6 g  G, Q- w: Q. T' Y, M! uWhen sufferred ESD pulse(ns),GGNMOS be turned on by coupling .$ d+ |6 P1 a1 b3 S9 B. q
If adding inverter between RC and clamp NMOS,it will speed up clamp NMOS turned on.
( o2 ?* M. Q( ^( `Just for reference !!!
22#
發表於 2010-5-27 10:56:55 | 只看該作者
謝謝大大的分享~更加了解esd的重要性
23#
發表於 2011-11-2 10:18:02 | 只看該作者
如果在輸出端加CDM,那輸出端的ESD MOS等於白做
7 v4 s3 E8 w6 m0 G6 n
3 X6 O. N/ S9 l: Q一般CDM diode size相較ESD MOS size來說小的多0 ?( ]) d" d6 U  f
如果同時加上CDM diode,肯定會先死在CDM diode上。
24#
發表於 2011-12-6 08:42:20 | 只看該作者
谢谢诸位的分享,
25#
發表於 2012-1-2 09:45:52 | 只看該作者
回復 20# ihcnqkm ! V3 Z( |& ~/ p8 B( N# B1 c( o: i
6 n+ x  V+ |5 v9 I/ r8 X0 l% t

- O1 G% V+ A" H7 c- @    很有用啊 ~谢谢各位的提点
26#
發表於 2012-7-12 12:19:45 | 只看該作者
学习学习!!!!!!
27#
發表於 2012-10-20 15:02:46 | 只看該作者
学习了,谢谢大家啊~~~~~~~~~~~~~~
28#
發表於 2021-8-25 09:57:36 | 只看該作者
感謝大大的分享,受益無窮
% G, t  B) ]- q" P; e( [6 d5 f/ v2 c4 z5 m8 E
謝謝
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