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樓主: michael6172
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[問題求助] 用verilog撰寫取對數log電路

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1#
發表於 2010-12-15 23:48:26 | 顯示全部樓層
先回覆,改天在來看code! N9 E* t# r& ?7 O+ Q
$ j5 t! h! `' I: b* R6 \
我也有在做對數轉換器
$ L, r* X% K9 h) c0 q% \; ]& l* a我是將數字表示成 N = 2^k(1+x). p1 r7 g+ {! @
以Mitchell的方法為基礎進行改良
- s. L0 R2 V% n
, g: f# E! d" e2 Q3 y4 e4 V好久沒上來了XD
0 O# j7 D' b6 a上一次來是在問FPGA方面的東西  s& M8 h. I9 o9 ^& W: U
因為要在上面實做對數轉換器
* U1 ~) V" g! i  \1 m7 G不過那時沒得到協助1 e. u- n0 o3 ?/ _/ h- J6 F
幸好最後有成功做出來
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