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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › 用verilog撰寫取對數log電路
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[問題求助] 用verilog撰寫取對數log電路

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1#
發表於 2008-5-14 17:58:06 | 顯示全部樓層
Verilog 新手看到這個Code
! i- H2 I2 j8 X& X4 V0 _
3 r8 F8 R* V9 f1 O* c6 w6 |0 C希望可以快快完成老闆交代的工作../ W0 R3 F6 M$ R7 s1 p# H- k

& |% W$ ^* t" g' D0 ~1 z真是太感謝你提供程式啦!!!
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