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[企業求才] 【深圳】招聘 数字逻辑设计经理

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發表於 2014-7-20 21:26:55 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
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+ g0 w1 q) q; O, i1、大学本科微电子专业,八年以上相关工作经验,或者硕士微电子专业,六年以上相关工作经验,或者微电子专业博士毕业,三年以上工作经验,经历过从概念到芯片产品量产的全过程# e- |* z" T" {& v; f! y
2、有5年以上数字电路设计经验,需熟悉WiFi射频处理算法
  f7 Z+ {  `4 h2 l7 R' @  C0 @8 z3、有多颗IC的量产经验,做过2.4G WiFi芯片者优先% a* b( p1 Y' E* `( z9 ~- _
4、熟练使用数字IC设计的EDA工具,包括仿真、综合、时序分析等
! Y# Z0 n2 Z  V7 g5、英语CET-4,具有良好的英语读写能力
8 L) @! J/ d; i! U0 G9 e' A" ?6、具有较强的逻辑思维能力、良好的沟通能力和一定的团队协调能力6 l, k6 W$ Q3 d0 ~
7、认真踏实,有责任心,工作积极主动
7 _1 [0 ]# [7 z- ]* V9 T: K0 d: q& d6 Z
% R* Q6 O9 s" Y  p9 h  S6 m; v% }职责范围:
; S( S1 W9 G6 I) t4 V: G; b( l1、根据算法或设计规范编写RTL代码并撰写设计文档
: x5 S# s6 Y; r2、负责指导团队内其他数字设计工程师的设计和验证
' P  p  @( z. C2 W8 f2 }8 L4 C3、芯片数字部分整体的综合,时序分析和优化逻辑电路+ |, Q. w" I' I8 j& B! n
4、负责指导测试工程师完成芯片的debug/validation/testing
& Z) ]! t0 r4 q3 c- D, M; }5、负责产品定义,和市场销售部门紧密配合制定三年至五年期产品路线图,. p5 n6 J9 q8 A2 I  M
6、负责数字逻辑模块设计和验证的审核制度,对最终产品成败负责& \4 c6 T6 ?( [0 y/ s8 u
7、开发数字系统架构,参考模型,测试计划,测试环境等一整套工作流程+ U5 D8 @2 W5 E2 z' N) s2 e2 R+ I
8、具有较强的电路设计推导分析能力,扎实的正向芯片设计能力,以及芯片样本的分析测试能力。: L+ l. K  `, V
9、有MTK, BroadCom, RealTek, Atheros等芯片设计公司相关的工作经验的最好,优先考虑。8 w% r$ n5 T! A+ o5 e& c, Z
10、有至少2款RF芯片的实际流片及测试经历。
; W- k8 R* l' x) F( H) c) }, d7 W3 W( j8 S( l! }1 F
技能要求:
& B+ x: j' ?1 o: ~* |2 \# H1、熟悉数字逻辑设计的前端和后端设计方法,涉及工具,以及设计流程
% G0 ]* y4 G5 T! z8 Y# t2、掌握数字逻辑前端设计,重点要求RTL编码(Verilog, SystemVerilog, C, C++, SystemC),验证,最好有数字综合和静态时序分析的经验
( e0 `4 T3 R2 _9 h3、熟练利用UVM, OVM, VMM, 或者eRM等方法创建有约束条件下的数字逻辑验证环境0 s0 Q" Q0 C( y; e# B$ m! Y; x
4、熟练运用检查工具建立和分析function coverage, assertion coverage, 以及code coverage
3 T/ }$ p- H8 a# x6 I; d5、掌握FPGA算法实施,和验证的流程,工具和调试
# I3 f( R2 |8 d# g$ E3 X2 o6、掌握从制定性能指标到流片测试的全套工程设计流程,有相关的项目流片经验* N$ C& m: v- M, F
7、掌握必需的设计工具,例如Cadence工具(SoC Encounter RTL compiler), 或者 Synopsys工具 (Design Compiler, and Primetime)8 a. m; @  V0 S1 p9 u7 K
8、具有低功耗设计的实际经验
; u( w" D  m% C) }2 x9、可以进行脚本编写,Perl, UNIX Shell, Python等等3 z1 H0 K2 f, O; u: }" t/ I+ @
10、熟练英语阅读、听说和文档写作技能
& i) s- w' [' ^, \11、具有很强的创新理念,解决问题的能力,和与中外同事有良好的团队合作精神
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