Cortex-M0/M3/M4 Source Codes

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Cortex-M0/M3/M4 Source Codes

iconstart@gmail.com

├─AT420-DA-03001-r2p0-00rel0
│  └─docs
' z* g* l$ w: C$ b4 N- `% R; Q│          DDI0337G_cortex_m3_r2p0_trm.pdf
│         
( Z2 j+ F( X  B" o├─AT420-DC-02008-r2p0-00rel0
│  └─docs
; r3 q2 v, @$ m' h' _4 x6 S│          DII0194A_cortex_m3_r2p0_csg.pdf
│         
├─AT420-DC-13001-r2p0-00rel0
, _. f+ u+ H: U. k│  └─docs
- X3 C& `( L! J# |5 _
│  │  │          CM3CodeMux.v
6 r  i: y* W7 |│  │  │          CM3flashmux.v
  R# h# y" m) D( O4 V( o│  │  │          CM3ROMTable.v
' P/ |1 @: _  V* X│  │  │          CortexM3Integration.v
3 i6 F/ t5 P9 ~2 D- W( T0 j  M8 X: q│  │  │         
│  │  ├─dapswjdp
│  │  │  │  README_DAPSWJDP
' O2 p4 ^# I" y- M: p$ v6 f│  │  │  │  
│  │  │  └─verilog
│  │  │          DAPDpApbDefs.v
- M; t$ t3 p" e7 \) T│  │  │          DAPDpApbIfClamp.v
│  │  │          DAPDpApbSync.v
7 O% V2 [) B: H8 o│  │  │          DAPDpClamp0.v
│  │  │          DAPDpEnSync.v
│  │  │          DAPDpIMux.v
/ f3 ?- r. s0 Z! U: ^! d, @3 D" Z/ a) Y│  │  │          DAPDpSync.v
│  │  │          DAPJtagDpDefs.v
│  │  │          DAPJtagDpProtocol.v
. z1 n! Q8 W9 v$ ~/ O. s- n│  │  │          DAPSwDpApbIf.v
│  │  │          DAPSwDpDefs.v
7 M+ B; y/ T. W( s8 q; v+ Q│  │  │          DAPSwDpProtocol.v
( k" {9 D1 w+ d6 \│  │  │          DAPSwDpSync.v
│  │  │          DAPSWJDP.v
│  │  │          DAPSwjDpDefs.v
│  │  │          DAPSwjWatcher.v
) \2 Y/ k; Y* H, q4 y/ a- W│  │  │         
│  │  ├─models
│  │  │  └─cells
$ J4 [; J3 q& \- v# {) \│  │  │          CM3ClkGate.v
│  │  │          CM3EtmClkGate.v
  m- ~# o3 [% I" C2 l│  │  │          CM3Sync.v
# j4 H5 n* ~2 [0 ^; V$ v- U- ]3 D+ w│  │  │         
/ w1 s% R; h+ y, P0 M  f  ?) `│  │  └─tbench
│  │      └─verilog
( P7 Z1 q& u( u1 G# t│  │              AhbToApb.v
│  │              AtbLogger.v
│  │              BusMatrix.v
│  │              ClkReset.v
$ O  V5 r  {5 }( j9 N3 @/ ?8 `. d│  │              CM3BusComparator.v
3 b* H. c. @. H

! V: d5 f, N4 r& ^) i5 d│      │  │  exclude_list.sc_waitstate

             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
  O% B) {1 m# y8 ]. G             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
, ~  Z; {9 H: ~! Y1 M/ R             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
) p/ J0 A4 M5 Q/ g/ r' V( |. ]             │      │  
8 B0 T4 m+ [4 k/ V. Q7 ^' h) S             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
             │              cells_1.geo
             │              cells_1.pwr
             │              index.cli
             │              README.TXT
             │              rulesets
- L; L0 b% g6 P8 w, R             │              VERSION.TXT
             │              vias_1.geo
             │              
             └─tsmc
                 └─t-n90-lo-sp-002-f1_1_6a_20060914
' f0 {# s8 \. D. X                     └─6X2Z
                             corner.defs

├─integration_kit
│  ├─logical
│  │  ├─cm0ikmcu
: [2 Y. W0 a" l│  │  │  └─verilog
" a1 ^  Z1 j$ S+ ^│  │  └─tbench
│  │      └─verilog
; J% \) V3 X, W9 x( X│  └─validation
│      ├─glogs
) s! H. j* S- W% [│      ├─logs
& V2 E% m! u5 T│      ├─mdk
│      ├─srpg
│      ├─tests
│      │  └─CMSIS
* G; p1 K/ h; r" L/ s, H0 L│      │      └─Core
% H1 l4 q1 B5 r9 q1 C│      │          ├─CM0
: g1 {) E! J, \+ h2 i+ b3 Y0 K6 I│      │          └─Documentation
5 u' s- d+ Y( F0 y5 Y" g) Q: c3 e│      └─vectors
├─ipxact
5 W  D- Y" z, _7 [  e5 r" Y; ~3 ]2 l│  ├─busdefs
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