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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Analog/RFIC討論區 › FOLDED CASCODE OP 在TSMC 0.25um製程
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[問題求助] FOLDED CASCODE OP 在TSMC 0.25um製程

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1#
發表於 2012-9-6 11:28:12 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
請問 各位前輩 我跑FOLDED CASCODE OP 在TSMC 0.25um製程下都用5V元件simulation 但VDD=5V gain 60dB但在VDD低壓2.5V gain 75dB + S5 e7 E& ?* m+ [" B
我是用理想current mirror 方式提供電壓 為何gain 差異大
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finster
2#
發表於 2012-9-16 23:57:51 | 只看該作者
你檢查一下你的偏壓點和op的電流,應該是在vdd<2.5V,某些元件的電流己進入線性區
2 q: T' L6 f8 T  l5 o& a8 q4 P+ Z故而才會導致gain往上跑
& k& l% j; @* y3 P( I5 K! B這時,可調整偏壓電路的size,應可改善
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