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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › latch up

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[問題求助] latch up

1^#

發表於 2011-6-1 19:58:19 | 顯示全部樓層

把CMOS操作於低溫中，溫度降低BIOPLAR元件之電流增曾變小，使NPN及PNPBIOPLAR元件之電流增益乘積不易達到1。----這是我的解法之一。

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2^#

發表於 2011-6-7 19:38:28 | 顯示全部樓層

動真格認真的說，產生latch up並單只有在ic layout，製程或rd設計的電路也可能latch up的狀況產生，

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