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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › EDA 設計討論區 › low power design的模擬環境
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[問題求助] low power design的模擬環境

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wsc223
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1#
發表於 2010-8-9 18:23:44 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位大大好" _4 q  l' k' b" T3 z- C
因為開始要著手low power design的方面
- N5 W' l  C' [$ U  j, q: B( |& d小弟想請問一下
; W& S. ?0 g3 @& X/ q) {) ~有什麼tool或是模擬軟件能夠用來幫助low power的設計呢
& v/ F; r% m1 w9 s(比如說Dynamic Voltage Scanning 或是 multi-Vdd等的使用): \5 P- `$ Q% i2 `2 X% X
2 F6 ]/ o* K) r, q2 T2 Z  \
謝謝
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lee100
2#
發表於 2012-1-9 13:24:52 | 只看該作者
you may try UPF/CPF for low power designs
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