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樓主: kyokanasaki
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[市場探討] 眾人都會IC設計

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21#
發表於 2010-10-10 15:12:07 | 只看該作者
even 是digital IC3 O! |+ t8 F9 n
說難不難,說容易也不容易,
' ]( ~. {0 x- Z' y會做的還是缺創意
22#
發表於 2010-10-25 08:10:05 | 只看該作者
編輯觀點:你是否樂見下一代也投身工程師職業?
! k  U3 `( J( F6 j5 k9 P- d電子工程專輯 - ‎2010年10月21日‎1 \% l3 o  l1 [4 W) I1 K+ `) ?
% Q% l, u" m& H8 f& J
我們常聽EETimes的電子工程師讀者聊到,他們打算阻止自己的子女未來從事相同職業,所持的理由很多種,但大多數人的結論是,在全球化的趨勢下,當工程師幾乎不可能成就一番大事業,也越來越難餬口。 這真是很悲哀…其中一個可能導致的結果,是讓大量人才轉向投入金融服務等 ...
23#
發表於 2010-11-14 12:16:57 | 只看該作者
官大學問大!
/ {( ?1 c& ^5 c% m應該說眾老闆(含教授及主管)都會IC設計,
- j9 D8 `" u+ G; k; a/ ?/ _因為他們的知識大多來自下屬及學生的報告,
/ g  M% V/ B5 K) L/ r5 ]老闆每次都跟客戶吹牛他設計的電路有多難,
% m# o& H/ B/ a" a0 n3 |實際上那電路根本都是他的工程師幫他設計的.
24#
發表於 2010-11-17 11:35:29 | 只看該作者
回復 23# liger " b5 P/ V8 X! C' J# o

8 T: e* k( a) U& }' t
. A' t5 h3 L3 ^( y, Q. g" ~也不全然是這樣, 也許您待的是大公司吧?!
1 Z2 J# v: p$ ~3 ~若是待start-up, 主管沒一定本事可是沒人會去挖角的....
  c+ ]. E. B: \& ?IC設計的功力, 最基本的電路部份有了一定修為之後, 差別就在debug的能力了
- P( ?$ m# [0 R9 a這部份得靠經驗累積....
25#
發表於 2010-12-8 17:02:12 | 只看該作者
感謝24#前輩的回復,的確我的講法有點一概而論,
+ a/ T; e8 ^0 e: j5 G( C& T不過通常會出來開design house大多是數位領域出身的老前輩,: }+ [. E6 e  {. e
所以是否為類比人才他跟本沒有能力去判斷,- G% I6 K6 Y/ G0 {: `6 v: [
且自己很愛面子,以吐嘈別人來裝懂,甚至還會說數位比類比難,
3 c& |4 m) I# k$ W' \下屬還要裝作很受教的樣子.
0 l  a7 [  @4 W0 m累.....(沒辦法花錢是大爺嘛)
26#
發表於 2010-12-30 08:51:58 | 只看該作者
主要看自己是否喜欢,有多大的把握可以做好!
27#
發表於 2010-12-31 08:57:14 | 只看該作者
非常贊同15樓的說法,不見得是資工的,即便是EE科班的也有很多會一些logic就以為自己多強,
+ z) C7 W; F, E  C( l: `% V$ n只是一些騙女生的把戲而已,說實在的真的要訓練一個數位工程師只要三個月的時間.
28#
發表於 2011-1-14 00:04:18 | 只看該作者
微电子设计需要研究所的水平吧 在下严重感觉这样
29#
發表於 2011-1-22 04:30:34 | 只看該作者
说IC设计简单 如果是资深前辈 当然有不同的见地; 如果想做科技攻关, 有能力的话就不会在这里侃侃而谈了吧.
30#
發表於 2011-3-12 09:03:32 | 只看該作者
我適感覺順其自然~: Y/ ?/ j) c& ~* X& C( E
當你能力夠 又強
: _/ W9 q6 h+ ]- K; I- U老闆當然會讓你起來
31#
發表於 2011-4-6 18:18:12 | 只看該作者
我是數學系畢業的, 於民國90年轉入IC設計,* K+ g1 a% c" I1 d2 k6 n
撰寫Verilog確實不難, 大約半年就可出師了,- K6 c. H; }* z, m# ]( k* H
又加上有FPGA可以驗證, 所以出錯的機率著實不高,
; B. l, F2 G8 a5 H7 H0 W但那只能說function work, 要達到量產, 還有一段距離,
5 ^. u  G. u- u2 s( E1 ^5 z以下是我經驗:7 S6 Z8 F* ]6 E8 S4 Y7 ~# t( d
1. 現在的IC不可能是純數位, 所以會有analog circuit在IC中,
7 T. N4 _$ `! ?    最難的就是analog與digital interface,1 v8 n2 C5 g. z
    常常就是analog simulation ok, digital用FPGA verification也ok,7 z* M3 W  Y, T4 ]: t* O, Q
    但實際開出IC卻有問題, 而且弄不清楚是analog還是digital.
! ~6 c( K1 E/ ~! c, d4 M2. 現在IC cost-down很嚴重, 所以Verilog大家都會寫,( b" P% W: E0 M. q8 s0 w' R
    但要怎麼把die size縮小, 那就是一門學問了.
7 A6 e; Z4 d- f* J3. 測試又是另一個問題, 雖然有tool可以產生test-pattern,) C) j# `6 ]) J. n+ k
    但要怎麼把測試的覆蓋率提高, 又是個挑戰.
3 n2 d2 o8 @( n0 P7 \0 k/ `5 g4. 另外, 還有一個重要的課題...EMC,
% E- v/ i( a; W, M3 E" j9 d1 w' ~    這個就要有很多的經驗值了, 因為都是要IC出來後才知好壞.1 l7 \5 L' X5 V% C2 o
5. 最後, 雖然有tool能修改code降低power consumption,! I0 m1 p, r$ s/ m* S- C+ {) j
    但不注意對正常function有時會影響到, 所以需要一些經驗值.
" s4 T* O% r% A以上就是我的看法, 給大家參考.
32#
發表於 2012-4-17 17:43:51 | 只看該作者
回復 10# jasonlhb
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