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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 請問TSMC 90nm DRC ERROR 麻煩了！感謝！
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[問題求助] 請問TSMC 90nm DRC ERROR 麻煩了！感謝！

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1#
發表於 2009-9-20 16:20:14 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
由於之前都用CIC的虛擬製程.這是第一次用真的製程所以我完全沒有頭緒.請各位前輩幫幫忙.謝謝- G  Q/ ~. m; r- \5 v
我LAY完一個子電路後跑DRC.但它出現以下幾個錯誤...（幾乎都是同一類錯誤.超多）* ]# Q, _# I7 G
1.  DOD.R.1 {@ DOD is a must. DOD CAD layer must be different from OD's./ y) H7 v) w' _$ M- M/ c" t
                   CHIP_CHAMFERED NOT INTERACT DOD }
2 S8 L, c* I! o( @/ }# a2. CSR.R.1.NWi {@ NWi is not allowed inside the empty area of chip corner.  b; v+ a8 T. x; n' h
                   EMPTY_AREA AND NWi }
$ d) `! n# ~- l2 a! y) s3. DUTM.R.1 {@ DUTM is must. The DUTM CAD layer must be different from the the UTM CAD ; r" N& r4 j3 X
                     layer.$ _  K) i2 |% ^, m7 h0 f
                     CHIP_CHAMFERED NOT INTERACT DUUTM }
. i' \' B; ]. C/ U6 U# e1 H) k# Y- |! I# n7 Z3 ~
麻煩了！
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小包
8#
發表於 2009-10-22 22:58:07 | 只看該作者

回復 7# 的帖子

哈哈哈…所以吸血驗証軟體指的是dracula嗎!!?
( N7 E1 B0 l: A/ ?3 m: M3 v0 D0 H6 [原來我一直在用的就是吸血驗証軟體…( T/ z0 F* z+ k) H5 e; B, U
這個名稱還滿好笑的……
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7#
發表於 2009-10-21 14:48:26 | 只看該作者
原帖由 小包 於 2009-10-20 12:04 AM 發表 ) P4 s8 _/ x% U. s
我知道卡利柏驗證軟體指的是calibre吧~- f3 b0 c8 K4 w, B  F; R' Z
那可以請問一下吸血鬼驗証軟體是…!!?
<<<<<沒記錯 virtuoso都是內建的DRACULA
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小包
6#
發表於 2009-10-20 00:04:44 | 只看該作者
我知道卡利柏驗證軟體指的是calibre吧~. @$ b, P. L0 ]  P0 [9 `
那可以請問一下吸血鬼驗証軟體是…!!?
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5#
 樓主| 發表於 2009-9-22 19:18:00 | 只看該作者
真的很感謝M大!!問題大概解決了!!謝謝~~~!!!!!!!!
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4#
發表於 2009-9-22 14:31:03 | 只看該作者
恩!!!感謝m大!!原來還可以改DRC command file 喔!!請問要怎麼mark掉
& S( C/ l( t1 ]就是在這行 //#DEFINE FULL＿CHIP0 b/ P* E& R) F! R, b. h! [" I( @
在前面加 2 個 // 那行就被mark 不會被執行 (卡利柏驗證軟體)" m! K+ G0 ?4 \+ ]" K
如果是吸血鬼驗證軟體 就是在前面加一個分號  ;/ t5 S. T7 }* s0 @. @
還有DRC command file是指那個file,就是跑drc那個file嗎?- z: O! R1 u& j; n
是的  有人說  rule file 也有人說  command file; D9 m' g7 S, @

; {' Q" B# g! H$ N還有再請問一個題外話!在畫MOS時.利用finger將mos的width : # Y: n- l! W4 K
變小.跟不用finger,width很大.有什麼差?如果不考慮noise) _' T5 j- A2 y
  也不是RFMOS.那這樣除了寄生電容稍大還會有什麼不好的?( _4 d. t& B9 M
沒瞎密差,也沒瞎密不好 通常是以整體考慮
7 d$ K# j% j+ y" H4 A  g" _0 G 例如 整排都是 w=5   只有 一個 w=20  那就是 鶴立雞群ㄌ& S  ~1 H4 P0 `% [7 O% H
通常會做成 finger 4  統整高度, 這類問題會先和 designer 討論
6 ^4 r! b  y0 ?& v4 I2 N1 l後 做決定 有時電路有其考量  參考參考
+ \4 F- O- Q% |& }& f1 h% ]0 N, F* }' \: e3 U4 L; ]/ R2 l3 ]
:
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3#
 樓主| 發表於 2009-9-21 22:29:31 | 只看該作者
恩!!!感謝m大!!原來還可以改DRC command file 喔!!請問要怎麼mark掉?, A: l3 B8 ^+ O/ o
還有DRC command file是指那個file,就是跑drc那個file嗎?7 V# K0 t* L0 r7 j! }+ L

' T( i8 J' @) }% r6 }! i還有再請問一個題外話!在畫MOS時.利用finger將mos的width ( |) e3 C( o. E) L7 h" Z% k# _  t' |
變小.跟不用finger,width很大.有什麼差?如果不考慮noise
( d; n5 x3 M' l! |& a, a也不是RFMOS.那這樣除了寄生電容稍大還會有什麼不好的?8 _# |- x( o) M# V1 B
% Z$ I% g! o4 ?# P' l. B4 p
[ 本帖最後由 henry90176 於 2009-9-21 10:31 PM 編輯 ]
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2#
發表於 2009-9-21 13:54:35 | 只看該作者
2．是不能在角落的地方放layer
# c) F1 E( B, V+ y8 S$ } 整體來看應該是 turn on ㄌ full chip check% k1 \& E+ v: J) B3 z
在 DRC command file 先把它 mark 掉 9 A7 {+ t( [6 _6 B
在 whole chip 時再來 RUN 會比較清楚些
" W3 b1 G* m# z; j; O; o////#DEFINE FULL＿CHIP
- T4 d: g4 z* J0 I4 |仔細研究一下 design rule % r0 ^! k% ?  r9 ?) [6 m
應該會有幫助
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