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[問題求助] 如何进行模拟除法器的设计

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1#
發表於 2009-4-22 09:52:45 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
各位大虾,最近要进行一个模拟除法器的设计,但是网上的资料好少,书本上讲的也不多。实在不知道如何下手,不知道有谁做过除法器的,模拟CMOS工艺的最好的。能否提供点线索或者资料,非常感谢大家!
+ `9 \: ~8 g' l+ `! D, X3 l还有一点就是,有一种结构是用运放和乘法器来构成的,不知道这种结构性能怎么样啊?
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2#
發表於 2009-4-22 16:49:51 | 只看該作者
要做除法器) N+ T, e+ @) C8 t3 x. M. f: L
關鍵在要做多少resolution
% ~' y' i6 [% N幾bit ?
- z/ T8 _; F0 t( L( I. g2 i
/ \/ O: V4 l4 H; _3 _resolution會影響架構的選擇...
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