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樓主: jauylmz
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在Layout時最花時間的工作是....

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21#
發表於 2007-12-25 09:32:04 | 只看該作者
1.我也認為 floor plan 最麻煩,因為一個好的 floor plan 除了能讓訊號線走的順之外,也可以節省面積. r9 @1 O9 ^& ]' a! b
2.接下來我覺得比較重要的是 power and ground line 的跑線,因為要走的順才是最重要的,而且若POWER途中一直換線其實也會降低它的電流
! s+ x6 h/ p1 {9 l* f3.接下來我覺得都還好,因為 DRC LVS block 刻好就會 RUN 了 ,另外create block本來就需要花一點時間
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22#
發表於 2007-12-25 11:52:01 | 只看該作者
如果位置沒有排列好ㄉ話!面積會變大∼甚至拉線會亂七八糟ㄉ∼
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23#
發表於 2008-1-27 11:14:54 | 只看該作者
最花時間的應該是  給你的空間不夠
1 o! {1 U. i- W% P: P你勉強把東西 塞進去之後  好不容易做完
4 R+ q5 L0 l/ q0 X+ l結果電路圖又變了  你就完了
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24#
發表於 2008-2-5 20:17:01 | 只看該作者
以我們公司來說
$ c/ e2 L' \; K2 L# K: t, F一直改圖對LAYOUT來說是最花時間的
* @  d$ J  k- G5 [或者是 沒有看清楚 RD寫的NOTE
0 R3 w! n% x' }' l* R& p( I/ u$ `8 P導致LAYOUT雖然能過LVS 但是LAY法卻是錯誤的) }+ C* C. B6 {. x4 e6 Q% ?

4 w9 p6 D+ A4 t& a. ^0 ~8 J3 \/ a/ D- y有時候我們公司RD也不想讓LAYOUT一直改
" }" }7 V* H; H: [; v1 Q2 v只是因為有時專案太趕
3 r: d- I+ Z8 h+ K所以只好跟LAYOUT同時平行做6 y1 @1 U: X& g
這樣就容易電路常常會大翻盤
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25#
發表於 2008-3-19 13:01:26 | 只看該作者
我是選擇排列~~~8 C3 g( j- W) j+ L6 I" q3 C
光是排列就會影響後續走線
$ `5 P+ _7 O; u( A& n/ b所以要特別注意~~~
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26#
發表於 2008-3-25 09:49:52 | 只看該作者
元件的排列、拉線都會有很多要求之類的
1 p. i; i: V$ X6 W最辛苦的就是改圖~原本己經畫好的,但是rd突然說要改圖
2 J5 N1 X  l2 f" z然後整個的大小不變,但是改的地方,又比原來的大一些
4 {0 P4 I. x- _) z2 Q, A' d這是最麻煩最痛苦的
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27#
發表於 2008-5-26 22:19:14 | 只看該作者
Re-layout往往是floorplan做得不好,所以floorplan是很重要。
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28#
 樓主| 發表於 2008-7-9 18:34:24 | 只看該作者
Chip Integration    可以算是拉線和DRC/LVS 嗎
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29#
發表於 2008-9-9 09:36:20 | 只看該作者
其實上述所有選項都基於兩個字 : "溝通".如果與designer溝通不良,即使畫的像藝術品一樣,花的在久精神部局與除錯,只要designer說不是他要的,一切枉然,全部重來.
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30#
發表於 2008-9-10 14:56:03 | 只看該作者
以上皆非& u6 y- P' w2 A6 a, g

$ o3 m  m: v/ P& K; Y我花最多時間的是在思考,2 Y: k: e/ K, c/ S* }) F
一個5天該完成的案子,我可能會花去2~3天思考
; w; Z8 X1 |) P: g- m) q事前想的仔細,
0 Y/ c4 k) `4 c" V- H4 y+ T開始動手layout一直到驗證完成都會很快而且順利。
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31#
發表於 2008-10-23 16:34:30 | 只看該作者
都很耗時間!!!  只要 動手 下去做  都是 耗時間!!!  哈哈~~~  用呼叫的 自動拉線  才是王道~~
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32#
發表於 2008-10-27 17:07:49 | 只看該作者
布局和整合最难,最能体现实力!。。。。。。。。。。。。。。。
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33#
發表於 2008-11-9 00:01:28 | 只看該作者
我也認為排列的部分還是會花費較久的時間,可能是因為剛接觸Layout沒多久,經驗不足顯得更無力!
$ K  a- ~$ N* Z# X整合這部份,如果是自己獨立一人完成,雖然時間耗費較多,但是就跟寫程式一樣,如何去安排自己的line能走得順
9 z) v& l. Q1 T% }" ], }9 H我想這才是最重要的!重點一句:還是經驗比較實際吧
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34#
發表於 2008-11-18 11:04:16 | 只看該作者
有不花時間的嗎+ x7 {" B* w4 W5 Y
LAYOUT我覺得每項都很花時間
4 R( J+ f  Y5 R2 ]' t( l1 m1 i" u3 Y不管是佈局還是LVS/DRC3 w3 q* \8 p3 {5 g# M
每項都得小心翼翼3 a. l. C+ H: G# B0 I7 b
做快不見得好
$ ?5 Z6 H' {3 c/ R  S做對才是重要
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35#
發表於 2009-4-9 01:03:28 | 只看該作者
我也覺得 floor plan 最麻煩~
# d# t% r- A: w因要如何將每個block充分擺到適當的位子~
( `3 |. Y/ w( W* d3 h" O這是一種學問~. z( m1 a/ R* Y
因擺的好的話~! h- h4 |. p5 U% F/ T) w
其他的閃線或拉power一切都還滿ok的
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36#
發表於 2009-4-24 13:19:48 | 只看該作者
2.  排列 Placement   
3 X4 \) s) I2 A6.  整合 Chip Integration3 C# ^8 t# |% j# M, y; A/ b7 \
7.  溝通 communication
( U# T! B: C" Z  z% K這三個最麻煩
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37#
發表於 2009-6-27 01:02:39 | 只看該作者
排列最花時間吧$ n/ `' w+ f3 j: ~& z" ]

$ T( f/ t+ ~+ _' g7 Q6 {$ a/ E在layout初期就要花很多時間先想好如何排列
! {9 {: n& Z7 w7 |2 P0 p4 I" h$ a- ^% m
想好後,反而才會省下大量的時間
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38#
發表於 2009-7-4 12:07:08 | 只看該作者
位置該怎麼擺真的需要一開始的計畫...
; o/ I7 [1 Y, W. n5 W要不然最後會發生難以挽回的錯誤啊>.<
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39#
發表於 2009-7-8 11:56:51 | 只看該作者
floor  plan比較花時間  只要floor plan 做好   
, K  U! }5 k$ @' ]5 V
. z( g- E* p- C0 r" m" J其他就會很快   相對LVS 問題也比較好除錯) Y0 W( s. T" d# I: L1 D" Y
% n6 j& ?3 R) U% C
HR.概念有  應該DRC LVS比較不會有問題吧
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40#
發表於 2009-9-3 09:08:46 | 只看該作者
我覺得placement和溝通是花最多時間的,因為會決定你的做法和拉線的容易度,
* F% u+ b8 A) G' w* h$ h$ ]再整合時也會是另一個問題
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