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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › 請問要使用何種EDA Tool (Verilog新手)
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[問題求助] 請問要使用何種EDA Tool (Verilog新手)

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day766
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1#
發表於 2007-7-26 18:48:58 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
用Verilog描述出的DSP processor，有tool可以把code轉換成Datapath或元件結構圖嗎？$ r5 G# h  [5 A; z( [8 \
很抱歉！剛自學Verilog，所以對tool和功能不是很了解。
( {! w; R5 j* e. C% b1 y, H9 cModelSim or A-HDL此類的軟體可以做到嗎？# M% P" n! Z2 S! N5 r: E7 A% F" C
另外，有沒有可以觀摩DSP Processor的資源呢？
: h" W' r- N2 U) h% s: U例如www.opencores.org
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2#
發表於 2007-7-29 19:36:53 | 只看該作者
dubussy
# h0 z3 t+ C+ OISE' u8 a; t, ]$ d) K  M8 V
DC) h- a& W9 m/ C/ N1 P" m  Y8 l5 Y
這三套你試試

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day766 + 5 非常感謝

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waky
3#
發表於 2007-8-3 16:54:01 | 只看該作者
只用过debussy% Z. x* F$ L: U% S0 W
另外两个没有用过,我也是个新手
5 O- y0 V+ n& M. p刚刚入门,希望前辈们多多教导
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4#
發表於 2007-8-6 13:46:10 | 只看該作者
大家多多交流多分享吧
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day766
5#
 樓主| 發表於 2007-8-8 19:29:04 | 只看該作者
最近對學校的系統漸漸了解了，所以用Design Vision或是DVE (聽說是Design Vision的新版)這兩套軟體。只要在元件上點選Schematic View，就可以看到block diagram了。
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6#
發表於 2007-8-22 11:41:41 | 只看該作者

回復 #1 day766 的帖子

你可以找一下 xilinx "System Generator for DSP"
4 F% j9 d/ |- L0 c- P這套軟體是架在mathlab 下面,可將你的dsp演算轉換成verilog or VHDL code 然後再將產生的code 加入當成ip ,連一連就可以用了,只試過demo板,還不錯用
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7#
發表於 2007-8-22 11:47:30 | 只看該作者
沒錯 這套軟體蠻好用的
* _* C! G5 J: h, B& N
* v6 r3 S% G4 O' w. O0 q& [號稱不用做 HDL coding
. I- |" \: I. L& l' [% A- @  L0 h5 K& Z+ Z/ v$ I1 B" J
但是只能用在 Xilinx FPGA 無法做成ASIC
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