FPGA-Based Prototyping on your current project

sophiew

In your verification flow, please select the primary EDA vendor/tool your team is using for...
' a. h9 O: r; l# I& ]- a% A! r' O# W
5 t2 W" x5 ]! gIf other (please specify), or you don’t know?

atitizz

Altera與Cavium合作，為網路應用提供經過預先驗證的資料封包分類解決方案
* y  Q4 V, M% A! }2 l可立即部署實施的解決方案採用了Altera的Interlaken Look Aside IP以及Cavium的NEURON Search處理器

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2014年6月24日，台灣——Altera公司（NASDAQ：ALTR）今天宣佈，其Interlaken Look-Aside矽智財（IP）核心通過了測試，與Cavium的NEURON Search™處理器相容。這一個可立即部署實施、經過預先驗證的解決方案，為網路OEM提供了低延時、高性能資料封包介面，適用於包括路由器、交換器、防火牆以及安全儲存在內的多種網路應用。Interlaken Look-Aside IP核心目前以Altera系列同類最佳IP核心組成的形式提供，經過最佳化，整合在Altera Arria® 10和Stratix® V FPGA中，具有性能優異、延時低和面積利用率高等優點。
3 S) I  |; i. Y; b, w' E% H# h
Altera採用FPGA架構的Interlaken Look-Aside解決方案實現了資料通路元件與旁視輔助運算器之間的相互操作，其傳送速率高達300 Gbps，性能達到每秒5億資料封包以上。Interlaken Look-Aside IP不但性能優異，而且還提供軟式核心邏輯和硬式核心邏輯模組，客戶能夠非常靈活的進行用戶介面、通路和資料速率配置，提高了整合度。

atitizz

Altera與Cavium使用Stratix V FPGA和NEURON Search處理器，測試並驗證了Interlaken Look-Aside解決方案。低延時資料封包介面，以及可擴展儲存空間支援實現高性能、大容量存取控制列表（ACL）與資料封包分類應用。Altera提供了相互操作性報告，介紹了使用Altera Interlaken Look-Aside IP核心與Cavium NEURON Search處理器的測試方法以及性能標準。

9 I% `; F$ T' \1 _Altera軟體和IP市場部總監Alex Grbic表示：「Altera同類最佳的IP核心設計實現了業界最佳性能、最低延時和最少資源佔用。我們與Cavium合作，展示了我們產品之間的相互操作性，我們的客戶能夠充滿信心的使用業界領先的解決方案。」
- x+ g5 d/ R5 H% u3 o
現在已經開始發售Cavium的NEURON Search處理器系列，主要針對多種高性能L2-L4網路搜索應用。Search處理器系列支援1百萬條IPv4和IPv6規則，每秒實現數百萬次搜索，最大功率消耗不到20W。NEURON Search處理器在儲存規則和指定規則表格式方面非常靈活。

Cavium的NEURON Search處理器產品線產品市場總監Weishan Sun表示：「Altera與Cavium的資料封包分類方案，是我們客戶所需的低風險高性能協同處理解決方案。Altera的Interlaken Look-Aside IP結合Cavium的NEURON Search處理器，是一種易於整合的解決方案，與沒有經過預先驗證的硬體方案相比，支援我們的客戶快速啟動電路板開發，節省了寶貴的工程時間和材料。」

ranica

Hardware Applications Engineer – Cores
; p- b; s# E/ N$ x0 s
& O5 ^: A' ]+ b% R公      司：A famous IC company
7 a9 y6 I: E9 u' `工作地点：上海
: o! m1 K% z& r: {
Job Requirements：
0 m/ y. X0 J8 E1 H0 }Qualifications
1 I  H* ~# i) K3 BGood university degree, in Computer Science or Electronics Engineering ideally, although other science graduates would be considered if they have relevant experience.

Experience
   Minimum of 3 years industrial experience
   Strong understanding of XX processors
   Experience or knowledge of FPGA or ASIC design, simulation and/or verification techniques, including RTL coding and simulation, in Verilog or VHDL
   Understanding of FPGA or ASIC implementation flows (synthesis, scan insertion, layout)
$ E' |7 k0 Z  e7 g   A good understanding of the interaction between software and hardware
   Demonstrable experience of problem solving and debug skills
0 k& R! H/ o7 n+ f5 |' ~; N0 s   Experience of interacting with colleagues outside of China

ranica

Desirable
   Knowledge of XX architecture and AMBA protocol
   C/C++, assembler coding or other programming skills.
2 H7 Y( T3 j2 b& ]- q! h* i   Experience in integrating SoC peripherals
& t( J  o0 G. G6 G' I+ |
( O0 _  u4 i( I1 S/ k3 ]. D  MPersonal Requirements
   Must be self-motivated, self-managing, responsible and proactive
! r( ?4 @+ n, [) E1 W   Must have excellent written and verbal communication skills with both colleagues and customers, including good written and spoken English
7 R! @# p- b' b! O2 O! m   Must be proactive in obtaining engineering or management input, in order to complete project and internal tasks in a timely and accurate manner
: b4 @9 @  m; F! Y! b( Q3 R5 f" U   Must have the desire and ability to solve problems quickly
  @3 `3 a; {) Y, Q' r! S# w   Must be enthusiastic and well driven
   Must be able to schedule own workload and plan tasks – based on both internal and customer requirements.  
   Must have good inter-personal skills, and be able to work well within a team; especially when under pressure
   Must be willing to be flexible and accept new challenges.
   Must be able to travel on a regular basis, both to give customer training and also for internal business reasons.

mister_liu

美高森美完整的新型SmartFusion2 SoC FPGA評估工具套件 讓OEM廠商可加速原型設計和應用開發
2 M' v0 h* ^3 J功能豐富且負擔得起的平臺使得OEM廠商可利用SmartFusion2在同級產品中的最低功耗
高可靠性特性和同級產品中的最佳安全性，並以顯著的上市時間優勢構建具有高度差異化的產品

! G0 I2 L0 c  k7 m) k
1 J  d2 C0 J9 C9 s. Q  J& G- Y4 ]功率、安全性、可靠度和效能差異化半導體解決方案的領先供應商美高森美公司(Microsemi Corporation，紐約納斯達克交易所代號：MSCC) 宣佈提供新型先進的SmartFusion®2 SoC FPGA評估工具套件，新的SmartFusion2評估工具套件是一款易於使用、功能豐富且價格負擔得起的平臺，它的設計讓設計人員可快速、輕易地加速其應用的評估或原型設計。OEM廠商使用美高森美的主流SmartFusion2 FPGA器件，可以充分利用這些器件在同級產品中的最低功耗、高可靠性性能和同級產品中的最佳安全性技術，來構建具有高度差異化的產品，並協助他們贏得顯著的上市時間優勢。

mister_liu

舉例來說，SmartFusion2評估工具套件可以簡化基於收發器 I/O 的FPGA設計之開發，這種FPGA設計是現今例如PCI Express (PCIe)和基於 Gigabit乙太網等系統所不可或缺的一環。為了加快評估和原型設計，美高森美先進的評估板與小外形尺寸的PCIe相符，這讓它可以應用到任何具有PCIe插槽的桌上型電腦或膝上型電腦。市場研究機構Infonetics指出，載波乙太網市場將於2017年增長到大約390億美元。

美高森美軟體和系統工程總監Venkatesh Narayanan表示：“我們新的SmartFusion2 SoC FPGA評估工具套件充分利用公司作為市場領導廠商所擁有的豐富經驗，是那些剛剛開始使用基於FPGA處理器之設計人員的理想開發平臺。由於設計人員無需從頭開始，因此我們讓新設計的實施變得更簡易。對於OEM廠商來說，讓設計快速實現是一件非常重要的事，美高森美新的工具套件為客戶提供了其所最需要的主流功能，以非常合理的價位提供了25K LE SmartFusion2 主流FPGA和SERDES評估功能。”

這款工具套件提供了全面的功能集，包括PCIe、Gigabit 乙太網、全雙工SERDES SMA線對、DDR記憶體、SPI Flash、USB On-The-Go和數個可為廣泛的應用開發建立其所需靈活性的擴展介面。藉著購買評估工具套件，開發人員還可以使用美高森美全系列業界領先的開發資源，例如參考設計和發佈範例應用展示的能力。

ranica

Senior Digital Design Engineer
& ]3 L/ A$ h- A2 i
  k: B5 |+ w+ A6 u1 I/ l公      司：A famous European IC company
$ K- e! ?' S% n( @5 s& Q工作地点：上海

# u$ {9 R7 D) U# J' m) b( ZJob description  
- define system partitioning of s/c circuits and system  
4 h; u1 S0 M, i* g6 J) l- define HW/SW co-partitioning  
- provide technical feasibilities based on system simulation and/or FPGA based demonstrator  
- propose new technical solutions on s/c and system level  
7 n# G7 y+ Y: S8 b1 n$ P# U; c$ y- design digital part of mixed signal (smart power) ASICs  
- close cooperation and interaction with international teams  
% ~( ^: z, F4 S, a4 K- f8 `- coach junior engineers  
$ s% |! F, e- y. v/ J9 ^2 I
" ~( A: A2 s+ L$ T+ ZRequired knowledge competencies and attributes  
- master degree in microelectronic circuits or systems, Communications, Computer Engineering (or equivalent)
* }: U# B; |& o) }* j- > 5ys experience in digital design  
- good understanding of ASIC mixed signal flow (Cadence based)  
- strong background in HDL coding, verification and toplevel integration  
% X6 l: ], P; q* Z. E2 P% e& u# v- good understanding of communication interfaces used in Automotive (SPI, CAN, LIN, Flexray)  
# K, ?) |, w7 S$ a# ?- experience in FPGA development  
9 ^/ T  l+ K) ?' J' t  s- very good communication skills (written, oral)  
- self motivated and high level of flexibility  
+ }/ J! s, ~+ d- foreign languages: English, German (not a must)

globe0968

Altera計畫推出符合軍用溫度規範的20 nm FPGA與SoC元件
* q. N% r9 g3 o; d5 iArria 10 FPGA與 SoC通過Mil Temp的檢定，可應用於軍事客戶，
* s( y8 S4 a! P在設計航空電子、雷達與其他高可靠性應用時，可以進行早期的規格決定

2014年8月27日，台灣──Altera公司（NASDAQ：ALTR）今天宣佈將為它最新的20 nm Arria® 10 FPGA與SoC，進行軍用溫度（Mil Temp）的認證計畫，也就是將會通過極端溫度環境（室溫-55℃到125℃）的檢定。除了這個分級之外，Altera還在速度等級、通訊協定，以及外部記憶體介面上提供指導準則，以便最佳地配合特定應用的需求。所有的元件都將通過Altera進行的鑑別、檢定與測試，以提供較短與可靠的交貨前置時間。客戶可以透過在myAltera Military Portal設定一個帳號，以便接收通知、取得分級與軍用溫度手冊。
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1 D: S* [& T3 H7 d, BAltera軍事、航太與政府事業部資深總監David Gamba表示：「Altera透過確保我們多樣的下一代產品都能夠符合Mil Temp的規範，這是支援軍事客戶所做的承諾，雖然並非所有的國防應用都會在Mil Temp規範的極端條件範圍下運作，但是這些資格認證計畫的早期通知，還是可以提供客戶在目前便進行有價值的平台設計決定，隨後再來進行成本效益的變化，且更易於進行設計的轉移。」
  ]# ~) G* ~1 a) U4 v% s2 x
Arria 10具有硬式浮點DSP區塊功能
Altera的Arria 10 FPGA與SoC元件是業界唯一具有整合式、符合IEEE 754規範的硬體式浮點運算元FPGA元件，相較於市場上其他的硬式浮點解決方案，它能夠提供業界最高的每瓦GFLOPS效能。在Arria 10元件中的硬式浮點DSP區塊可易於提供內建的浮點支援，因此能夠縮短6到12個月的開發時間。這些巨集指令對於許多軍事與航太應用非常有用，包括從即時戰略決策應用到廣視野衛星偵察平台，它們也可以用於地面基地與空中相位矩陣雷達，以及指向性天線應用的精密設計之中。
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Arria 10 SoC也是業界唯一整合了ARM處理器的20 nm元件。

sophiew

FPGA工程师
公      司：A famous IC company
) N/ s$ Z8 t" v4 K工作地点：上海

! S! c0 S$ V0 Q) o岗位职责：  
1、负责各种FPGA原型平台的搭建、调试与维护  
2、根据项目需求，承担各种IP和SOC芯片的FPGA验证  
3、设计芯片项目的原型平台，协助软件工程师完成底层驱动编写、系统移植等  

' q9 X1 @2 V6 ~" y职位要求：  
1.大学本科及以上学历，电子、通信、计算机或微电子专业；  
2.有扎实的数字电路基础，熟悉Verilog等硬件描述语言的编程；  
3.有一定的嵌入式软件开发和板级硬件电路设计基础；  
7 {# a. l1 y7 c3 q0 B6 w4 q4.1~2年的FPGA相关工作经验；  
5.具有较强的学习能力、沟通能力和良好的团队合作精神；  
- S) q* s# B: {! a7 {- I! u6 J$ G" p6.有大型SOC芯片的FPGA平台开发者优先考虑。