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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 天線效應
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[問題求助] 天線效應

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1#
發表於 2011-7-6 10:32:06 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問數位電路會有天線效應的影響嗎?
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2#
發表於 2011-7-6 13:24:11 | 只看該作者
這就要看你的天線效應
/ [5 g5 j! ?; s+ ?! ]( _係指 瞎密 ㄌ" Y0 N! S& s. }4 J& |0 J: T3 i
跑線太長 通常會有 天線 效應 影響
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3#
發表於 2011-7-6 14:53:37 | 只看該作者
會有啊，天線效應是指芯片在製作的過程中，導線上積累了大量無處釋放的電荷，積累到一定程度會將gate擊穿，然後泄放，這樣mos會被損壞。所以天線效應的發生出現在芯片中任何連在gate的線上。不知道我說沒說明白，希望能對你有幫助。
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4#
 樓主| 發表於 2011-7-7 09:05:55 | 只看該作者
會有啊，天線效應是指芯片在製作的過程中，導線上積累了大量無處釋放的電荷，積累到一定程度會將gate擊穿， ...
+ L1 H8 _, A$ ?0 {terriours 發表於 2011-7-6 02:53 PM

3 `6 m' {6 B9 M. D
' X+ Q0 m4 G& d& I/ S( ~: e
$ ]0 ?$ r3 C6 C; K( X) m    嗯呵~我了解哩!
$ g% s" ^, F4 @4 {    只是想確認一下!
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5#
發表於 2011-7-7 13:24:16 | 只看該作者
回復 3# terriours
' H6 x, T2 }  o  L: o& l! L- O* K5 X4 J6 i- U9 B" m  O
之到原理後~~不知道有沒有任何有效的解法可以防止呢!!  謝謝
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6#
發表於 2011-7-7 15:45:54 | 只看該作者
回復 4# bernie820
7 _/ G9 i; }& Y% Q2 R& {: l& p( v" [  X4 r
哦，呵呵，不好意思
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7#
發表於 2011-7-7 15:55:41 | 只看該作者
回復  terriours
6 n: m# ]3 }" B0 a$ P( g' P" r9 ?6 T$ M; ]$ v/ N  V: J8 b
之到原理後~~不知道有沒有任何有效的解法可以防止呢!!  謝謝 ...
- `9 x* l9 m' |( nsydjeffrey21345 發表於 2011-7-7 13:24

0 l& U9 S4 Z' |8 s
9 b# z9 K2 L7 A- z1 P! z解决天线效应有两个方法：
' k! U) {' x/ K3 @" u2 k方法一：在发生antenna effect的gate连线上进行“跳线”，所谓“跳线”就是将底层metal线换成高层的metal线。这样做的原理简单是：在process的過程中，每一個連接工藝步驟后都會進行一次靜電荷的 釋放，所以在metal上的靜電荷會被放掉，就杜絕了antenna effect的發生；
& f! {) v5 l. ?% _7 t7 X. K4 g方法二：也可以在連線上加一個對地反向偏執的diode，這樣在工藝製作過程中，就可以自動放電，並不是網上通常說的把這個反向diode擊穿放電，有時候這個反向diode的大小也是要考慮的。
, E! E6 z# C( j! Z9 n基本上就是這樣的，希望能幫到你。
4 S  _' `, y, L8 k) H如上所述有錯誤，希望一起討論。
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8#
 樓主| 發表於 2011-7-7 20:59:09 | 只看該作者
回復  terriours
2 u* C# n9 y% g) s! ~: @" ^1 v3 o3 L$ ]% u2 L1 P4 [
之到原理後~~不知道有沒有任何有效的解法可以防止呢!!  謝謝 ...
1 A/ v& ~, ^: X) Z) _1 D4 x+ gsydjeffrey21345 發表於 2011-7-7 01:24 PM
5 V1 L% j. b! k9 X: K2 `
9 Y. W2 X& w' [( l, E, X- f

) c, `- R! ]" U# H7 k! I    有呀!!1 d# K! w) z5 H3 X; o8 L! k, C) ~
; Z+ H9 M) n! x4 k: Y  k  V
    最簡單的一個方法就是利用不同層金屬做連接
: y7 z' K, T9 N! @' v5 |1 l
, e/ ?9 l# y+ v; U" y2 P   就是說假設一條50um長的連接線
. `0 u5 }1 e& b& @: ~
9 e8 @. y9 G3 M& Y9 L   用二到三層金屬完成這樣長的線(很多講義都有提到喔)9 M6 k# o5 S7 g; @
8 ]' i4 I/ K) [( x, z1 Z
   另外還有兩種方式我不太會用!4 _. w$ T/ }$ p: s9 f7 B
6 j# K0 a; B. M( [/ W- c  m1 O
    希望有幫助到你^^
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minzyyl
9#
發表於 2011-7-10 22:55:14 | 只看該作者
解决天线效应有两个方法：
" |: z, R& W6 M! U4 ?方法一：在发生antenna effect的gate连线上进行“跳线”，所谓“跳线”就是将 ...' S& Z* q0 W  G* H- I
terriours 發表於 2011-7-7 03:55 PM
5 @2 n$ K- K4 L9 y) _9 H3 }2 P7 C# J
2 N. d* g  X& u2 d* p; |9 D3 n. D- k

$ i5 l# @  b( T* Q4 n. f, Y' P    共同探討。  h- c8 t/ [, j% D  l, q" y
1，每層工藝后有個步驟對金屬進行靜電釋放，那麼當製作到上層的時候，有的金屬和下層又鏈接到一起了，那麼這個靜電會產生積累嗎？爲什麽?) h0 P2 i6 h. K4 Q# y5 Y
2, diode所謂的自動放電？如何理解？
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10#
發表於 2011-7-26 17:57:16 | 只看該作者
學習學習學習學習學習學習學習學習學習學習學習學習
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ninesky
11#
發表於 2011-12-2 11:10:41 | 只看該作者
ant通常就是出現在數位電路的
0 I" _& u2 e# ]; Gapr的跑線隨便一條就是幾百um
' O& ]+ O/ G: ^* F/ I如果不用tool先修好
; G. F" m0 k! _4 @: |! e9 I* s隨便一個小chip就讓你修到昏天黑地
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12#
發表於 2011-12-13 09:46:56 | 只看該作者
学习了，感谢！看来很多不懂啊。
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13#
發表於 2011-12-29 11:41:51 | 只看該作者
DIODE 換LAYER 其實這些東西在DESIGN RULE都有說到
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rd66529
14#
發表於 2011-12-30 17:20:53 | 只看該作者
謝謝你啦~受益良多阿~感謝大大無私地分享
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15#
發表於 2012-1-8 14:41:18 | 只看該作者
用二到三層金屬完成這樣長的線(很多講義都有提到喔)
. X3 a6 o! y. d" U是並在一起還是跳層??
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vic
16#
發表於 2012-2-3 19:17:25 | 只看該作者
感謝各位先進解說，讓我對天線效應更清楚了，受益良多！
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postme
17#
發表於 2012-2-12 13:12:35 | 只看該作者
共同探討。
/ h2 M, |% M6 u1，每層工藝后有個步驟對金屬進行靜電釋放，那麼當製作到上層的時候，有的金屬和下層又 ...: ^+ _& H/ I: D* o. ]6 A! j6 C
minzyyl 發表於 2011-7-10 10:55 PM

3 e5 p7 @# h6 P9 T同问diode如何起到放电作用的？是靠漏电流来泄放的吗？
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18#
發表於 2013-9-30 14:10:33 | 只看該作者
請問　d　i　o　d　e　的　l　a　y　o　u　t　怎　麼　畫　??
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19#
發表於 2013-10-1 09:24:59 | 只看該作者
NMOS的POLY去掉就是了!
4 g. y0 d, W* s面積大小自定!
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20#
發表於 2013-10-5 22:29:02 | 只看該作者
回復 1# bernie820 8 O  M- \) X6 X) l

# e4 L: M5 H9 c% V- L; p0 M. c1 P" E! P8 L' J
數位電路也會有天線效應
6 c! l  X6 ~- B8 I其實版大忘了說,你是那層 Mt
$ V4 ^* [) c. y% c* h4 X所謂的跳線,要看地方的
! b) q7 Y# T# `1 k4 S我舉一個很多人都不明白的地方# z/ i! H4 q6 t9 o- q) p% V* e
如果你的 Mt3 有天線效應
* u1 o4 x" w# J5 A2 e0 m9 L你不能用 Mt1 or Mt2 來跳線( B7 i1 e/ R+ c& F, X* f# k
只能向上跳,非向下
* w2 E/ U- j( b( R建議你一定要讀懂 cmmand file 如果記載 ant
1 w0 v9 _; q* m
  B6 c8 {/ A8 z! e  IDiode所謂的自動放電？
. M/ [0 ?! |/ w/ |( c其實就是因為有 OD 這個 layer
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