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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 關於ESD與ADC layout的問題
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[問題求助] 關於ESD與ADC layout的問題

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tshiu
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1#
發表於 2009-9-17 18:30:35 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問關於adc layout: N" w* I- C$ O8 D
若在外圍PAD加上CIC提供的ESD(靜電防護)( n9 _& K1 w& @- s8 w: n* n) V
對於量測是否好?
. \: s, X8 k' b5 N我擔心因為加上ESD反而造成更大的電容負載, 會不利於量測.
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