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[問題求助] bandgap 噪声问题

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1#
發表於 2008-12-16 23:34:41 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
请教:3 a5 ]3 k/ @6 l2 g' h5 w) |# W
我是新手,在给射频电路做bandgap电路时,发现如果电源或者地上有100mV峰峰值,频率1GHz作于的噪声是,输出的参考电压会降低,
5 l& s# X) K! b- X# E9 E/ ~. k我对该结果的分析是:+ i9 ], B, s, n3 [6 H1 i
由于噪声的频率和幅度均比较大,噪声比较容易串扰到bandgap core的运放的输入端,由于串扰的路线不同,导致运放输入端的电压出现一个差值,5 _. J0 F% l: L. [( Y5 A& j8 k
因此环路开始调节,由于运放的带宽有限,不能够即使响应,而下一个噪声又继续串扰到运放的输入端,并且继续恶化输入端的电压差,导致环路
- n3 `- W6 ^0 Q4 h4 B6 M7 b调节不过来,而使得输出bandgap 电压继续下降。
+ G( Y+ f+ M% S! Z# S
: l+ n) u9 q& _/ G& e  P不知道我这样的分析合理不?还是因为我电路设计的问题?
& a! @1 X0 J; P0 l2 k* O$ }3 b大家在设计时,是否有遇到相同的现象?$ g7 F3 c% q$ c
6 g2 X( }$ e. V8 g" O& g
请高手指教!谢谢!
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9#
發表於 2009-1-10 13:32:03 | 只看該作者
小弟不才 沒做過BG外接C做補償
! ]6 C9 j+ m. l9 K* v# L' i. b- H1 k! B8 c6 l8 e
不過根據小弟做過LDO經驗
2 f; X+ y* t2 l7 {( d6 h0 w# r7 n' a5 L1 i6 r: D
外接 C 通例當做主極點  (當然也有例外)
7 ]8 `9 i/ b' ?- u8 ^8 n4 \3 v/ V7 I& A. E6 u! m- c
不過你連 ESD device 對穩定度的影響都考慮進去.......真是 深思熟慮 呀!!, r( n' ]" I- M. P+ f' n( h  w

" i% g6 A' A- A! y! s2 t自嘆不如~~ 跪拜了~~
8#
發表於 2009-1-10 13:12:40 | 只看該作者
具體的說,片外的cap和esd電阻產生一對零極點相互抵消,具體頻率多少算下就OK了
7#
發表於 2009-1-10 13:05:15 | 只看該作者
誰跟你說是2個相近低頻極點了,拜托你看清楚
( T& v  H) ^+ L: D是帶外極點,當然能穩定,這是常用結構
6#
發表於 2009-1-10 11:11:25 | 只看該作者
我不知道你的 次 是多次
1 i$ U, T* \$ O/ e' N但若有2個相近低頻極點; Y3 b. y7 g, e5 f. ?
系統若能穩定  我的姓到過來寫!
5#
發表於 2009-1-9 20:30:45 | 只看該作者
外掛cap一般做穩壓用,buffer內部極點仍然為主極點,雖然外掛cap大,但是相連接的ESD電阻小,多為次主極點,具體情況具體分析
4#
發表於 2009-1-9 13:54:26 | 只看該作者
bg 輸出端若沒回授 則穩壓濾波用0 E+ _4 U; z8 o2 \5 I2 F
若有接回授 則需模擬閉迴路穩定度
3#
發表於 2009-1-9 11:12:46 | 只看該作者
有片外loading cap做穩壓 ~? 那内补偿的意义在于?
2#
發表於 2009-1-7 17:51:03 | 只看該作者
可能的原因1)bandgap的psrr低,ref out受電源地影響大;& g8 P$ x( C9 K6 B& ?. \- a  d
2)不知道你的ref輸出到實際電路中,ref是否有片外loading cap做穩壓,減少后級電路對ref的串擾
2 \3 X; h; r' f8 d" h3)也有可能是ref buffer的驅動能力不夠,驅動阻性loading時 造成ref下降
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