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[問題求助] LDO问题

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1#
發表於 2008-11-1 18:40:56 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
请问各位高手?  U/ d* L+ }' V3 C+ q* ^; m, h6 S

, I: h0 b  A2 p1:请问这种结构的LDO,单位增益带宽由什么决定,一般的LDO带宽要求多少?, B& b) G( r" `+ r2 E' ~2 o% \
( k+ A! ]% y- @6 q
2:运算放大器第一级的输出极点怎么估算?对地的电阻是ro7和ro10的并联吗?对地电容是M7或M10漏端的总电容吗?
# ^6 Z# m2 H& h. v
' ?2 @' H) |& k! D- C0 C3:ro7可以用仿真结果中gds的倒数估算吗?漏端的总电容是cdtot吗?
. Z7 [. Z! G; k6 s! _4 }( B; Z$ S, X& Q" P! H! r

  d' u* d4 v4 k7 ^' M8 R9 I5 q
( f$ |9 k! q+ l# ?( V* |: J$ M, w0 Z( d
6 p% `  F& \( \* l) w
1 C3 t3 `, p. _
以下是 LDO 的相關討論:& h5 N. R% Q/ g3 e) Y, X
Low Drop-Out Voltage Regulators
4 x3 p; b" B' d2 d9 x+ m9 }' iRincon-Mora 《Analog IC Design with LDOs》
: B( i6 I$ |9 D5 l! @6 vPMOS Low_Dropout Voltage Regulator Introduction ) @9 Q2 G: W* u2 l  g1 ~
LCD Driver 設計術語簡介[Chip123月刊資料]: D2 }) r! e0 V7 u: p
The evolution of voltage regulators with focus on LDO[NS講義]
% v* e7 H+ c  i: a2 MDesign of High-Performance Voltage Regulators" g4 D6 @+ G2 a! j+ ^) E
?教有?LDO的??* v" r  B4 q0 F% k/ T; ^0 T
LDO DC-DC分壓電阻的疑問(等比例的差異!?)
6 N. S& L9 G) ]0 z# O8 }- YLDO??! M$ ^5 `; `4 K& p7 j2 X
高?LDO ????!, ~+ S* @4 p, ]

# V) S3 Q+ _$ g" t" A; f. A; t% r/ K! [  W0 J: a3 V5 \  f, @1 p0 k4 g
[ 本帖最後由 sjhor 於 2009-5-15 06:50 PM 編輯 ]

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12#
發表於 2010-6-11 15:46:29 | 只看該作者
3中ro7和漏端电容是可以这么算的
11#
發表於 2010-6-7 03:50:14 | 只看該作者
恩.....這個LDO顯然有穩定度的問題。! t3 M3 \! \1 g  @
在你第二個問題中,我認為應該先要確定你的補償方式,因為有些書出是第一個pole,有些則否。- Z) L0 n1 z5 u" T: ~
而且在某些補償法中,補償電路會影響到輸出阻抗。
10#
發表於 2010-4-5 21:19:00 | 只看該作者
你说的是两级运放的补偿方式,ldo的补偿方式有很多种的,还是应该先确定补偿方式吧。
9#
 樓主| 發表於 2008-11-9 18:59:18 | 只看該作者
为了相位裕度到60以上,需要将第1非主极点移到2倍单位增益带宽以外,不知道单位增益带宽的位置怎么定极点的位置啊?6 X$ y  P  ?$ a1 ^; B8 H
还有一部分补偿我没加上去,所以大家不要把问题盯在这个图上,这个图不是一个完整的LDO,我只是用它来做个例子来说明我的问题!
8#
發表於 2008-11-8 22:53:55 | 只看該作者

回復 7# 的帖子

建议你先把稳定性问题搞好,你的电路现在是不能稳定工作的!之后可以考虑提高带宽或者增益这类的问题!
7#
 樓主| 發表於 2008-11-8 16:32:08 | 只看該作者
大大们  能否按1,2,3回答一下,
* T( \* s, Z/ E4 z1 n整体的东西我都明白,我不明白的是具体点的东西,例如1,2,3!% C5 X. ~3 X$ {6 E

+ r' Y, f% f; `( P- g& u* |# |[ 本帖最後由 flying591 於 2008-11-8 04:56 PM 編輯 ]
6#
發表於 2008-11-8 13:49:37 | 只看該作者
LDO 因为其负载的变化很大,可能是电流,电阻还有电容负载' F; O; `4 L& m2 @
所以OP的稳定性要尽量check全面
/ L# W9 l) p. b7 q+ P, J! w另外PSRR也是LDO的一个重要考量参数。
5#
發表於 2008-11-5 00:07:01 | 只看該作者
一般來說,我們並不會特別去訂gain會是多少,但至少都會是在50dB以上
8 ]* x; {/ o, l  U1 T9 x而phase margin在無負載電流和最大負載電流時,至少都要在45度以上,以確保stability: K5 n1 w; K, |3 [1 G  g3 W; q
至於bandwidth,那就要看你的反應時間的規格要訂多少,然後才決定你的two-stage OP的bandwidth要設計在那個範圍4 Y0 t1 U! H9 w% ]) ?
8 u7 [3 S$ N) e! v" h
LDO的OP所看到的輸出是Power MOS,我並不明瞭你的第一級是指OP的第一級還是指LDO的第一級
  V; c5 b/ ]) J# l6 ?: Y$ L在設計LDO電路中,我們都是先設好好OP的gain和phase margin,然後再把Power MOS掛上去模擬,然後再回過頭來再來微調OP的gain和phase margin,尤其是在無負載電流和最大負載電流的情況,此時OP均需要能夠正常工作且不會有振盪的問題發生% u2 K. }; H* I7 w
所以,LDO電路中的OP並不是一次就會決定好其performance,因為這顆OP需要考量到後面那顆Power MOS,所以在設計與模擬上需要來來回回模擬好幾次,而且也需更動修改好幾次,絕不是你一開始就能夠依照規格就設計好
4#
 樓主| 發表於 2008-11-3 19:06:51 | 只看該作者
大大们帮忙看看啊!小弟 谢谢啦!!
3#
 樓主| 發表於 2008-11-2 16:34:38 | 只看該作者
原帖由 finster 於 2008-11-2 03:22 AM 發表
6 f0 L5 @( [  _, r, u- W! A你這是two-stage OP,需要作頻率補償,若沒有,會有振盪的情況發生; _: b( _9 ]' N( ]
建議你要加一下會比較保險,另外,OP一定要看phase margin,你這個電路的OP的phase margin應該會有振盪問題0 Y# b( T1 [( V$ \3 g! B" P, {

2 I3 P; o5 d& ?8 `) S另外,LDO需看負載的變化- s! `% w* e8 g1 D3 c1 y
亦即,當有負載電 ...
: r& m# b) p4 V" p7 Q6 d
7 m3 W) o2 d1 |; p% V" N3 t
补偿那部分我没加呢,我就想知道单位增益带宽是怎么确定的,和什么有关系?例如GB=一个表达式。一般的要求GB为多少啊?, W$ f# e) I+ r, V! B! M
还有的问题就是2:运算放大器第一级的输出极点怎么估算?对地的电阻是ro7和ro10的并联吗?对地电容是M7或M10漏端的总电容吗?
( P, Z1 S9 y0 }" c: m  l/ u4 {
+ r7 M4 I' x# z1 k2 V7 z0 |3:ro7可以用仿真结果中gds的倒数估算吗?漏端的总电容是cdtot吗?# ~0 s# a/ N0 O" R9 z6 ~# Q
帮忙解答一下。
2#
發表於 2008-11-2 03:22:06 | 只看該作者
你這是two-stage OP,需要作頻率補償,若沒有,會有振盪的情況發生
( |9 z$ x4 Y/ z+ |" H0 h# O建議你要加一下會比較保險,另外,OP一定要看phase margin,你這個電路的OP的phase margin應該會有振盪問題  S% K( r7 `/ x1 g: Y5 Q* Q

# ]  Y; [) n$ A" S另外,LDO需看負載的變化
; [3 [0 t' k/ d3 P4 z6 `1 n$ [亦即,當有負載電流時和無負載電流時,OP的phase margin均必需在45度以上才會是穩定的% A' L3 W& d6 ?
而至於bandwidth則看你的反應時間需要在多少的時間內穩定與反應來訂出
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