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[問題求助] 請問使用power ring會有出現此error呢?

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1#
發表於 2008-5-29 14:14:50 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
我已確認電路無誤,但在電路周圍畫上Power ring,Gnd ring就出現以下softchk的error訊息。8 P, s9 N- p1 _2 ?6 V; r! n3 a
請問有前輩知道原因嗎?
* M$ R/ F- n0 c/ F# U2 a/ n) b
9 N( k# a" S, ]: Y% R$ t錯誤訊息如下,. [: g5 b+ E1 `
check SOFTCHK SUBSTRATE UPPERALL.-2Errors$ h. X. y$ m/ T1 T; z8 c
7 ^# I% Z9 @% c9 Y
這兩個錯誤都是針對power ring。
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4#
發表於 2008-5-30 02:58:14 | 只看該作者
檢查一下,被power ring包起來的線路裡面的ground有沒有把電位接出來?
, V1 d1 [! s3 y, W感覺起來你的ground (p+ diff)似乎是由psub接起來的不是由metal連接
3#
 樓主| 發表於 2008-5-29 14:56:04 | 只看該作者
不好意思,我忘了補充還有出現Extraction Report的error,; ?5 u' {4 k2 m0 z9 S1 ~

8 O" k% J) h7 _4 F( A) _" [WARNING:  $ k' I7 P; ?; k- Q* Z4 a8 m1 k
          Stamping conflict in SCONNECT - Multiple source nets stamp one target net.' U* m0 k: s% d" a! b4 m
          Use LVS REPORT OPTION S or LVS SOFTCHK statement to obtain detailed information.; `6 @( J- R* `- @

. U5 a$ Y- y6 \1 I2 y9 Hcrtstal_blue前輩,謝謝您的回應,經檢查我的power pin沒有打錯,且怪就怪在若我的power ring 用nwell全包覆起來就會出現error,但若將power ring不完全包起來,而是呈現"C"狀,缺口再用metal層連接,此error就不見了。請問您有遇過這樣問題嗎??
2#
發表於 2008-5-29 14:24:02 | 只看該作者
你好:3 @1 S" t% W5 r" {4 c. J4 I0 I5 ^+ q
      一般來說出現SOFTCHECK的問題,就我的經驗所遇到的情況
" G5 y$ c  v+ q$ v- d都是因為下列的原因所產生的:
% q0 C/ B' M0 a! a7 ^, ~5 d6 n  O
1.POWER PIN 沒打上
& O  `8 @1 H& W9 n( H  ^2.POWER PIN打錯 (如 VDD OR GND 打相反)
5 [/ h' b& C2 ]2 S# [3.不同的電位沒用LAYER做區別(如SUB2 )
+ _, h5 y) D/ d/ r: @+ G
- k) ?4 s6 b" ?# }以上是我曾遇過的問題,提供給你參考。
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