Cortex-M0/M3/M4 Source Codes

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Cortex-M0/M3/M4 Source Codes

, R' A, A' r8 r* ~$ eiconstart@gmail.com

├─AT420-DA-03001-r2p0-00rel0
6 M6 M# N5 a5 s│  └─docs
5 u, f3 `, S* V! x4 r1 T│          DDI0337G_cortex_m3_r2p0_trm.pdf
│         
├─AT420-DC-02008-r2p0-00rel0
$ ~: e* I' s2 \0 }│  └─docs
$ |' U- B) k' X2 A3 o+ j# d" O- K│          DII0194A_cortex_m3_r2p0_csg.pdf
* A4 e& i  l8 A0 U3 i+ ~│         
├─AT420-DC-13001-r2p0-00rel0
│  └─docs
9 n2 R# Y7 I- |& [4 i) x2 q4 Q
0 [/ U0 g7 V: G5 f│  │  │          CM3CodeMux.v
9 S+ d$ c: l, v! Q│  │  │          CM3flashmux.v
│  │  │          CM3ROMTable.v
│  │  │          CortexM3Integration.v
* D/ v& i. s. v, |5 \│  │  │         
$ _9 G* g( z8 E" w│  │  ├─dapswjdp
│  │  │  │  README_DAPSWJDP
│  │  │  │  
│  │  │  └─verilog
( k+ H! L- D) G1 `' l! r! t0 W│  │  │          DAPDpApbDefs.v
│  │  │          DAPDpApbIfClamp.v
│  │  │          DAPDpApbSync.v
│  │  │          DAPDpClamp0.v
3 o) M' e/ P& _6 c. j│  │  │          DAPDpEnSync.v
│  │  │          DAPDpIMux.v
7 A3 a, ~% B$ F4 p( |+ g  G│  │  │          DAPDpSync.v
│  │  │          DAPJtagDpDefs.v
) F  j; E. L6 H2 m7 S2 |5 D│  │  │          DAPJtagDpProtocol.v
: K4 O3 |) ?! Y6 D% H% k│  │  │          DAPSwDpApbIf.v
│  │  │          DAPSwDpDefs.v
' A% w+ F8 r) O  d# I, r│  │  │          DAPSwDpProtocol.v
, e5 u+ }8 B5 F: [│  │  │          DAPSwDpSync.v
│  │  │          DAPSWJDP.v
│  │  │          DAPSwjDpDefs.v
2 b  R. d; Y% A6 x! c' l│  │  │          DAPSwjWatcher.v
│  │  │         
1 W& d$ A2 r! l) K3 }" o/ c5 L# [│  │  ├─models
) R! A4 p& v5 ~│  │  │  └─cells
│  │  │          CM3ClkGate.v
) E: t, j+ [; l( l5 l, v│  │  │          CM3EtmClkGate.v
, |4 h4 p* ~  y9 `. Y( R1 j│  │  │          CM3Sync.v
! x: r( u0 ?4 W2 S│  │  │         
│  │  └─tbench
9 a/ U+ T+ A* ^! |9 ]$ R8 S│  │      └─verilog
│  │              AhbToApb.v
  ?+ R6 B7 ~. R" f* B( p2 h│  │              AtbLogger.v
( \+ q( \; j# Q" c) K! n7 {& e! j│  │              BusMatrix.v
) P; x& F+ I6 J/ j│  │              ClkReset.v
( G( T3 p9 v( _& S7 L│  │              CM3BusComparator.v

* m4 p$ D! T9 }6 ]+ y) S; W" }
│      │  │  exclude_list.sc_waitstate

             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
' h) p' ^6 S/ W! b             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
' H% L& n- I; _! M( l0 Z             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
' i" n0 m7 Q8 I. Y; N6 {             │      │  
" G. X0 j$ w! l2 p5 t7 g# E             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
( w5 i* h) R4 ?! M             │              cells_1.geo
' [# [+ ?3 O- V% W             │              cells_1.pwr
             │              index.cli
, S0 a' Z8 W. I4 A% U0 E; _5 N: m& ~             │              README.TXT
9 @5 X/ ?% h  f7 p5 D$ I7 S( W9 U. p             │              rulesets
+ n# F7 ^2 V* O/ `0 D" m! K8 y9 k             │              VERSION.TXT
0 J- w5 M& L  J) U             │              vias_1.geo
             │              
             └─tsmc
! C6 k+ T$ u/ s+ a2 E& Y. G; d/ K# g                 └─t-n90-lo-sp-002-f1_1_6a_20060914
                     └─6X2Z
                             corner.defs

├─integration_kit
# K7 p% ^6 C1 m│  ├─logical
│  │  ├─cm0ikmcu
│  │  │  └─verilog
│  │  └─tbench
8 @! ^  y. E9 L! g/ b" _: f│  │      └─verilog
; h6 t2 R/ H5 |7 q; {4 o* i6 I│  └─validation
│      ├─glogs
│      ├─logs
│      ├─mdk
6 q" |, g6 `+ u. C. V. E  y│      ├─srpg
│      ├─tests
│      │  └─CMSIS
* u# X# r/ L+ E1 X* b│      │      └─Core
│      │          ├─CM0
5 ^4 D% y* {! S5 y' a) B│      │          └─Documentation
# C* [9 s& b+ }: Z│      └─vectors
├─ipxact
* n6 r) N6 x3 R4 D# \, T│  ├─busdefs
│  │  ├─amba.com
│  │  │  └─AMBA3
│  │  └─arm.com
│  │      ├─CoreSight
│  │      ├─Cortex-M0
2 h$ x0 C: t6 \1 M: b8 ^7 j3 p│  │      └─CortexMCores
│  ├─channels
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3 O5 I* j) I# H& T/ s│  │          └─rtl
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